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1. (WO2016053722) DISPLAY HAVING VERTICAL GATE LINE EXTENSIONS AND MINIMIZED BORDERS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2016/053722    International Application No.:    PCT/US2015/051795
Publication Date: 07.04.2016 International Filing Date: 23.09.2015
IPC:
G09F 9/30 (2006.01), G02F 1/1345 (2006.01)
Applicants: APPLE INC. [US/US]; 1 Infinite Loop M/S 36-2pat Cupertino, CA 95014 (US)
Inventors: CHIU, Hao-lin; (US).
YANG, Byung Duk; (US).
HUANG, Chun-yao; (US).
KIM, Kyung Wook; (US).
CHANG, Shih Chang; (US).
LEE, Szu-Hsien; (US)
Agent: TREYZ, Victor G.; (US)
Priority Data:
14/504,215 01.10.2014 US
Title (EN) DISPLAY HAVING VERTICAL GATE LINE EXTENSIONS AND MINIMIZED BORDERS
(FR) DISPOSITIF D'AFFICHAGE AYANT DES EXTENSIONS LIGNE DE GRILLE VERTICALES ET DES BORDURES MINIMISÉES
Abstract: front page image
(EN)A display may have an array of pixels arranged in rows and columns. Each pixel may have a transistor for controlling the amount of output light associated with that pixel. The transistors may be thin-film transistors having active areas, first and second source-drain terminals, and gates. Gate lines may be used to distribute gate control signals to the gates of the transistors in each row. Data lines that run perpendicular to the gate lines may be used to distribute image data along columns of pixels. The gate lines may be connected to gate line extensions that run parallel to the data lines. The data lines may each overlap a respective one of the gate line extensions. Vias may be used to connect the gate line extensions to the gate lines. The gate line extensions may all have the same length.
(FR)L'invention concerne un dispositif d'affichage pouvant comprendre un réseau de pixels disposés en rangées et en colonnes. Chaque pixel peut comprendre un transistor pour commander la quantité de lumière de sortie associée à ce pixel. Les transistors peuvent être des transistors à film mince ayant des zones actives, des première et deuxième bornes de source-drain, et des gâchettes. Des lignes de gâchette peuvent être utilisées pour distribuer les signaux de commande de gâchette aux gâchettes des transistors dans chaque rangée. Des lignes de données qui s'étendent perpendiculairement aux lignes de gâchette peuvent être utilisées pour distribuer des données d'image le long des colonnes de pixels. Les lignes de gâchette peuvent être reliées à des extensions ligne de gâchette qui s'étendent parallèlement aux lignes de données. Les lignes de données peuvent chacune chevaucher l'une respective des extensions de ligne de gâchette. Des trous d'interconnexion peuvent être utilisés pour connecter les extensions de ligne de gâchette aux lignes de gâchette. Les extensions de ligne de gâchette peuvent toutes avoir la même longueur.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)