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1. (WO2015125971) TRANSLATION LOOKASIDE BUFFER HAVING CACHE EXISTENCE INFORMATION
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2015/125971    International Application No.:    PCT/JP2015/055245
Publication Date: 27.08.2015 International Filing Date: 24.02.2015
IPC:
G06F 12/10 (2006.01), G06F 12/08 (2006.01)
Applicants: KABUSHIKI KAISHA TOSHIBA [JP/JP]; 1-1, Shibaura 1-chome, Minato-ku, Tokyo 1058001 (JP)
Inventors: TAKEDA Susumu; (JP).
FUJITA Shinobu; (JP)
Agent: KATSUNUMA Hirohito; (JP)
Priority Data:
2014-033187 24.02.2014 JP
Title (EN) TRANSLATION LOOKASIDE BUFFER HAVING CACHE EXISTENCE INFORMATION
(FR) RÉPERTOIRE DE PAGES ACTIVES POSSÉDANT DES INFORMATIONS D'EXISTENCE DE MÉMOIRE CACHE
(JA) キャッシュ存在情報を有するTLB
Abstract: front page image
(EN)[Problem] To provide a cache memory system and a processor system with which access efficiency can be improved. [Solution] A cache memory system equipped with: a cache memory of one or more levels having a data cache unit that stores data and a tag unit that stores an address for each piece of data stored in the data cache unit; and a translation lookaside buffer (TLB) that stores page entry information, which includes address conversion information for converting from a virtual address generated by a processor to a physical address, and stores cache existence information, which indicates whether data corresponding to the respective converted physical addresses is stored in a specific cache memory of one or more levels.
(FR)Le problème décrit par l'invention est de concevoir un système de mémoire cache et un système de processeur avec lesquels on peut améliorer l'efficacité d'accès. La solution selon l'invention porte sur un système de mémoire cache équipé : d'une mémoire cache d'un ou de plusieurs niveaux comportant une unité de mise en mémoire cache de données qui mémorise des données et une unité d'étiquette qui mémorise une adresse pour chaque élément de données mémorisé dans l'unité de mise en mémoire cache de données ; et d'un répertoire de pages actives (TLB) qui mémorise des informations d'entrée de pages, qui comprennent des informations de conversion d'adresse permettant une conversion d'une adresse virtuelle générée par un processeur en une adresse physique, et qui mémorise des informations d'existence de mémoire cache, qui indiquent si des données correspondant aux adresses physiques converties respectives sont mémorisées dans une mémoire cache spécifique d'un ou de plusieurs niveaux.
(JA)【課題】アクセス効率を向上可能なキャッシュメモリシステムおよびプロセッサシステムを提供する。 【解決手段】キャッシュメモリシステムは、データを格納するデータキャッシュ部と前記データキャッシュ部に格納された各データのアドレスを格納するタグ部とを有する1階層以上のキャッシュメモリと、プロセッサが発行する仮想アドレスから物理アドレスへのアドレス変換情報を含むページエントリ情報と、変換した物理アドレスのそれぞれに対応するデータが1階層以上の特定のキャッシュメモリに格納されているか否かを示すキャッシュ存在情報と、を格納するトランスレーション・ルックアサイド・バッファと、を備える。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)