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1. (WO2015119950) DIAGNOSTIC SYSTEMS AND METHODS OF FINITE STATE MACHINES
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2015/119950    International Application No.:    PCT/US2015/014264
Publication Date: 13.08.2015 International Filing Date: 03.02.2015
Chapter 2 Demand Filed:    02.12.2015    
IPC:
G06F 11/22 (2006.01), G01R 19/165 (2006.01)
Applicants: QUALCOMM INCORPORATED [US/US]; ATTN: International IP Administration 5775 Morehouse Drive San Diego, California 92121-1714 (US)
Inventors: ROSIK, Raymond Keith; (US).
BIDERMANN, Steven M.; (US)
Agent: EDWARDS, Gary J.; (US)
Priority Data:
14/172,090 04.02.2014 US
Title (EN) DIAGNOSTIC SYSTEMS AND METHODS OF FINITE STATE MACHINES
(FR) SYSTÈMES ET PROCÉDÉS DE DIAGNOSTIC D'AUTOMATES D'ÉTATS FINIS
Abstract: front page image
(EN)In one embodiment, a power management integrated circuit comprises a finite state machine having a first terminal to receive a digital command signal, a second terminal to receive a clock signal, and a third terminal to receive a first reset signal to reset the finite state machine into a predetermined operational state. A plurality of diagnostic registers is configured to store a signal state of the digital command signal or a clock state of the clock signal, or both in response to the first reset signal. The diagnostic registers are configured to maintain the signal state or the clock state, or both after powering down of the power management integrated circuit in response to the first reset signal. The diagnostic registers are configured to allow retrieval of the stored signal state or the stored clock state, or both upon power on of the power management integrated circuit.
(FR)Dans un mode de réalisation, l'invention concerne un circuit intégré de gestion de puissance qui comprend un automate d'états finis ayant une première borne pour recevoir un signal de commande numérique, une deuxième borne pour recevoir un signal d'horloge et une troisième borne pour recevoir un premier signal de réinitialisation afin de réinitialiser l'automate d'états finis dans un état opérationnel prédéfini. Une pluralité de registres de diagnostic est configurée pour stocker un état de signal du signal de commande numérique ou un état d'horloge du signal d'horloge ou les deux, en réponse au premier signal de réinitialisation. Les registres de diagnostic sont configurés de manière à maintenir l'état de signal ou l'état d'horloge ou les deux après coupure de l'alimentation du circuit intégré de gestion de puissance en réponse au premier signal de réinitialisation. Les registres de diagnostic sont configurés de manière à permettre la récupération de l'état de signal stocké ou de l'état d'horloge stocké ou des deux lors de la mise sous tension du circuit intégré de gestion de puissance.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)