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1. (WO2015040658) INFORMATION PROCESSING METHOD, INFORMATION PROCESSING DEVICE, MEMORY CONTROLLER, AND MEMORY
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2015/040658    International Application No.:    PCT/JP2013/005598
Publication Date: 26.03.2015 International Filing Date: 20.09.2013
IPC:
G06F 12/16 (2006.01)
Applicants: FUJITSU LIMITED [JP/JP]; 1-1, Kamikodanaka 4-chome, Nakahara-ku, Kawasaki-shi, Kanagawa 2118588 (JP)
Inventors: HAYASAKA, Kazumi; (JP).
HIGETA, Masanori; (JP)
Agent: YOKOYAMA, Junichi; c/o FUJITSU LIMITED, 1-1, Kamikodanaka 4-chome, Nakahara-ku, Kawasaki-shi, Kanagawa 2118588 (JP)
Priority Data:
Title (EN) INFORMATION PROCESSING METHOD, INFORMATION PROCESSING DEVICE, MEMORY CONTROLLER, AND MEMORY
(FR) PROCÉDÉ DE TRAITEMENT D'INFORMATIONS, DISPOSITIF DE TRAITEMENT D'INFORMATIONS, CONTRÔLEUR DE MÉMOIRE ET MÉMOIRE
(JA) 情報処理方法、情報処理装置、メモリコントローラ及びメモリ
Abstract: front page image
(EN)The objective of the disclosed technology is to provide a method able to suppress erroneous operation of an information processing device on the basis of erroneous data and erroneous data reading even in the case that there has been a failure in the writing of data to memory. In the disclosed method, data to which a logical address has been imparted is written to a predetermined physical address of memory, and when the writing of data has not been carried out normally, a first flag is generated indicating that writing was not carried out normally and is stored associated with the logical address. By means of the first flag, it is possible for the fact that there is an error in data to which a specific logical address has been imparted to remain as a record. As a result, it is possible to prevent a computation processing node from reading erroneous data.
(FR)La technologie ci-décrite vise à proposer un procédé pouvant éviter le fonctionnement erroné d'un dispositif de traitement d'informations à cause de données erronées et de la lecture de données erronées, même lorsque l'écriture des données en mémoire a échoué. Dans ledit procédé, des données auxquelles une adresse logique a été attribuée sont écrites à une adresse physique prédéfinie de la mémoire, et lorsque l’écriture des données n'a pas été réalisée normalement, un premier fanion est généré pour indiquer que l'écriture n'a pas été réalisée normalement, et il est mémorisé en association avec l'adresse logique. Au moyen du premier fanion, il est possible qu'une erreur dans les données auxquelles une adresse logique spécifique a été attribuée reste enregistrée. En conséquence, il est possible d'éviter qu'un nœud de calcul lise des données erronées.
(JA) 開示の技術は、メモリへのデータの書込みに失敗した場合でも、誤データの読出し及び誤データに基づく情報処理装置の誤動作を抑制することができる方法を提供することを目的とする。 開示の方法によれば、論理アドレスが付されたデータを、メモリの所定の物理アドレスに対して書込み、データの書込みが正常に行われなかった場合には、書込みが正常に行われなかったことを示す第1フラグを生成して論理アドレスに対応付けて記憶する。第1フラグにより、特定の論理アドレスが付されたデータに誤りがあることを記録として残すことができる。これにより、演算処理ノードが誤データを読出すことを防止できる。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)