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1. (WO2015030426) COMPRESSION METHOD FOR REDUCING NETWORK LOAD WHEN DOWNLOADING FPGA IMAGE
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2015/030426    International Application No.:    PCT/KR2014/007778
Publication Date: 05.03.2015 International Filing Date: 21.08.2014
IPC:
G06T 9/00 (2006.01), G06T 1/00 (2006.01)
Applicants: SOLID TECHNOLOGIES INC. [KR/KR]; SOLID Space 220, Pangyoyeok-ro Bundang-gu Seongnam-si Gyeonggi-do 463-400 (KR)
Inventors: HONG, Dong Hoon; (KR).
HA, Chee Hoon; (KR).
LEE, Kil Soo; (KR).
KIM, Hyun Chae; (KR)
Agent: LEE, Un Cheol; (KR)
Priority Data:
10-2013-0104806 02.09.2013 KR
Title (EN) COMPRESSION METHOD FOR REDUCING NETWORK LOAD WHEN DOWNLOADING FPGA IMAGE
(FR) PROCÉDÉ DE COMPRESSION PERMETTANT DE RÉDUIRE UNE CHARGE RÉSEAU LORS DU TÉLÉCHARGEMENT D'UNE IMAGE FPGA
(KO) FPGA 이미지 다운로드시 네트워크 부하를 경감하기 위한 압축 방법
Abstract: front page image
(EN)The present invention relates to a compression method for reducing a network load when downloading an FPGA image, comprising the steps of: (a) receiving, by a Zero+8 compressor, 8-bit FPGA image data; (b) converting, by the Zero+8 compressor, the value of the 8-bit FPGA image data into a decimal number; (c) determining which value among "a value of 0," "a value of the square of 2," or "a value, other than the value of 0 and the value of the square of 2" is the value converted into the decimal number as a result of the determination of step (b); (d) as a result of the determination of step (c), if the value converted into the decimal number is "the value of 0," writing, by the Zero+8 compressor, 1-bit "0"; (e) reading, by the Zero+8 compressor, the next 8-bit FPGA image data; (f) determining, by the Zero+8 compressor, if there is a value to be read; and (g) as a result of the determination of step (f), terminating the process if there is no value to be read, and proceeding to the procedure of step (c) if there is a value to be read. According to the present invention as above, data can be immediately compressed and decompressed in byte unit, thereby performing compression by a Zero+8 compression algorithm that has low memory usage, and FPGA image data are compressed and decompressed in bit unit, thereby enabling real-time compression and decompression by minimizing the time taken to compress and decompress. In addition, the present invention has the effects of enabling efficient operation in an inexpensive CPU as well, and enabling efficient provision of an update to the FPGA image data even when an NMS management network is operated at a low speed.
(FR)La présente invention concerne un procédé de compression permettant de réduire une charge réseau lors du téléchargement d'une image FPGA, comprenant les étapes suivantes : (a) recevoir, par un compresseur Zéro+8, des données image FPGA 8 bits ; (b) convertir, par le compresseur Zéro+8, la valeur des données image FPGA 8 bits en un nombre décimal ; (c) déterminer quelle valeur parmi "une valeur 0", "une valeur du carré de 2", ou "une valeur autre que la valeur 0 et la valeur du carré de 2" est la valeur convertie en le nombre décimal suite à la détermination de l'étape (b) ; (d) suite à la détermination de l'étape (c), si la valeur convertie en le nombre décimal est "la valeur 0", écrire, par le compresseur Zéro+8, "0" 1 bit ; (e) lire, par le compresseur Zéro+8, les données image FPGA 8 bits suivantes ; (f) déterminer, par le compresseur Zéro+8, s'il existe une valeur à lire ; et (g) suite à la détermination de l'étape (f), terminer le processus s'il n'y a pas de valeur à lire, et reprendre la procédure à l'étape (c) s'il existe une valeur à lire. Selon la présente invention décrite ci-dessus, des données peuvent être compressées et décompressées immédiatement en unité d'octet, exécutant ainsi une compression par un algorithme de compression Zéro+8 utilisant faiblement la mémoire, et des données image FPGA sont compressées et décompressées en unité binaire, permettant ainsi une compression et une décompression en temps réel en minimisant le temps nécessaire pour compresser et décompresser. De plus, la présente invention a comme effets de permettre un fonctionnement efficace dans un CPU peu coûteux, et de fournir avantageusement une mise à jour des données image FPGA même lorsqu'un réseau de gestion NMS est opéré à faible vitesse.
(KO)본 발명은 FPGA 이미지 다운로드시 네트워크 부하를 경감하기 위한 압축 방법에 관한 것으로서, Zero+8 압축기가 8bit의 FPGA 이미지 데이터를 입력받는 (a) 단계; Zero+8 압축기가 8bit의 FPGA 이미지 데이터 값을 10진수로 변환하는 (b) 단계; (b) 단계의 판단결과, 10진수로 변환된 값이, '0 값', '2의 제곱 값', 또는 '0 값과 2의 제곱 값 외의 값' 중에 어느 값인지 판단하는 (c) 단계; (c) 단계의 판단결과, 10진수로 변환된 값이, '0 값'인 경우, Zero+8 압축기가 1bit의 '0'을 기록하는 (d) 단계; Zero+8 압축기가 다음 8bit의 FPGA 이미지 데이터를 읽는 (e) 단계; Zero+8 압축기가 읽을 값이 있는지 여부를 판단하는 (f) 단계; 및 (f) 단계의 판단결과, 읽을 값이 없는 경우 프로세스를 종료하고, 읽을 값이 있는 경우 (c) 단계로 절차를 이행하는 (g) 단계;를 포함한다. 상기와 같은 본 발명에 따르면, Byte 단위의 데이터를 바로 압축 및 해제할 수 있어 메모리 사용량이 적은 Zero+8압축 알고리즘을 통해 압축을 수행하되, FPGA 이미지 데이터를 Bit 단위로 압축 및 해제함으로써, 압축 및 해제 시 소요되는 시간 최소화를 통해 실시간 압축 및 해제가 가능하고, 저가의 CPU에서도 효율적인 운용이 가능하며, NMS 관리망이 저속인 상태에서도 효율적으로 FPGA 이미지 데이터를 업데이트를 제공하는 효과가 있다.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
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African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: Korean (KO)
Filing Language: Korean (KO)