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1. (WO2015027809) INSTRUCTION PROCESSING METHOD AND DEVICE, AND PROCESSOR
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2015/027809    International Application No.:    PCT/CN2014/083879
Publication Date: 05.03.2015 International Filing Date: 07.08.2014
IPC:
G06F 9/30 (2006.01)
Applicants: HUAWEI TECHNOLOGIES CO., LTD. [CN/CN]; Huawei Administration Building, Bantian, Longgang Shenzhen, Guangdong 518129 (CN)
Inventors: HOU, Rui; (CN).
GUO, Xubin; (CN).
FENG, Yujing; (CN).
WANG, Xishuang; (CN).
LI, Ye; (CN)
Priority Data:
201310389245.3 30.08.2013 CN
Title (EN) INSTRUCTION PROCESSING METHOD AND DEVICE, AND PROCESSOR
(FR) PROCÉDÉ ET DISPOSITIF DE TRAITEMENT D'INSTRUCTIONS, ET PROCESSEUR
(ZH) 指令处理方法及装置、处理器
Abstract: front page image
(EN)An instruction processing method and device, and a processor, which relate to the technical field of computers. The method comprises: when a plurality of instructions are sequentially read from a second cache of a processor, if it is determined that a special instruction sequence exists in the plurality of instructions, determining control codes corresponding to various instructions in the special instruction sequence; saving various instructions in the special instruction sequence and control codes corresponding thereto in a first cache of the processor; and if it is determined that an instruction read from the first cache of the processor has a corresponding control code, adjusting a microstructure of the processor according to the control code so as to make an assembly line of the processor have no pause, so that the working efficiency for the processor to execute an instruction can be optimized.
(FR)La présente invention concerne un procédé et un dispositif de traitement d'instructions, et un processeur, qui ont trait au domaine technique de l'informatique. Le procédé consiste à: lorsqu'une pluralité d'instructions sont séquentiellement lues dans un second cache d'un processeur, s'il est déterminé qu'il existe une séquence d'instructions spéciale dans la pluralité d'instructions, déterminer des codes de commande correspondant à diverses instructions présentes dans la séquence d'instructions spéciale; sauvegarder diverses instructions présentes dans la séquence d'instructions spéciale et des codes de commande leur correspondant dans un premier cache du processeur; et s'il est déterminé qu'une instruction lue dans le premier cache du processeur a un code de commande correspondant, régler une microstructure du processeur en fonction du code de commande de manière à amener une ligne d'assemblage du processeur a ne pas avoir de pause, pour que l'efficacité de travail avec laquelle le processeur exécute une instruction puisse être optimisée.
(ZH)一种指令处理方法及装置、处理器,涉及计算机技术领域。当从处理器的第二缓存中按序读取多条指令时,若确定所述多条指令中存在特殊指令序列,则确定所述特殊指令序列中各指令对应的控制码;将所述特殊指令序列中各指令及其对应的控制码保存到所述处理器的第一缓存中;若确定从所述处理器的第一缓存中读取的指令存在对应的控制码,则根据所述控制码调整所述处理器的微结构,使得所述处理器的流水线不停顿,可以优化处理器执行指令的工作效率。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: Chinese (ZH)
Filing Language: Chinese (ZH)