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1. (WO2014209708) INITIATION OF CACHE FLUSHES AND INVALIDATIONS ON GRAPHICS PROCESSORS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2014/209708    International Application No.:    PCT/US2014/042870
Publication Date: 31.12.2014 International Filing Date: 18.06.2014
IPC:
G06F 12/08 (2006.01), G06F 13/14 (2006.01)
Applicants: INTEL CORPORATION [US/US]; 2200 Mission College Boulevard Santa Clara, California 95054 (US) (AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BE, BF, BG, BH, BJ, BN, BR, BW, BY, BZ, CA, CF, CG, CH, CI, CL, CM, CN, CO, CR, CU, CY, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, FR, GA, GB, GD, GE, GH, GM, GN, GQ, GR, GT, GW, HN, HR, HU, ID, IE, IL, IN, IR, IS, IT, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MC, MD, ME, MG, MK, ML, MN, MR, MT, MW, MX, MY, MZ, NA, NE, NG, NI, NL, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SI, SK, SL, SM, SN, ST, SV, SY, SZ, TD, TG, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, UZ, VC, VN, ZA, ZM, ZW only).
GUPTA, Niraj [IN/IN]; (IN) (US only).
JIANG, Hong [US/US]; (US) (US only)
Inventors: GUPTA, Niraj; (IN).
JIANG, Hong; (US)
Agent: JORDAN, B. Delano; (US)
Priority Data:
13/926,328 25.06.2013 US
Title (EN) INITIATION OF CACHE FLUSHES AND INVALIDATIONS ON GRAPHICS PROCESSORS
(FR) INITIATION D'UNE PURGE DE MÉMOIRE CACHE ET INVALIDATIONS SUR DES PROCESSEURS GRAPHIQUES
Abstract: front page image
(EN)Methods and systems may provide for receiving, at a graphics processor, a workload from a host processor and using a kernel on the graphics processor to issue a thread group for execution of the workload on the graphics processor. Additionally, one or more coherency messages may be initiated, by the graphics processor, in response to a thread-related condition of one or more caches on the graphics processor. In one example, the thread-related condition is associated with the execution of the workload on the graphics processor and indicates that the one or more caches on the graphics processor are not coherent with a system memory associated with the host processor.
(FR)L'invention concerne des procédés et des systèmes permettant de recevoir, au niveau d'un processeur graphique, une charge de travail à partir d'un processeur hôte et d'utiliser un noyau sur le processeur graphique pour émettre un groupe de fils pour l'exécution de la charge de travail sur le processeur graphique. En outre, un ou plusieurs messages de cohérence peuvent être initiés, par le processeur graphique, en réponse à une condition liée à un fil d'une ou de plusieurs mémoires caches sur le processeur graphique. Dans un exemple, la condition liée à un fil est associée à l'exécution de la charge de travail sur le processeur graphique et indique que le ou les mémoires caches sur le processeur graphique ne sont pas cohérentes avec une mémoire système associée au processeur hôte.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)