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1. (WO2014202825) MICROPROCESSOR APPARATUS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2014/202825    International Application No.:    PCT/FI2013/050679
Publication Date: 24.12.2014 International Filing Date: 20.06.2013
IPC:
G06F 9/38 (2006.01), G06F 9/30 (2006.01), G06F 13/16 (2006.01)
Applicants: NOKIA TECHNOLOGIES OY [FI/FI]; Karaportti 3 FI-02610 Espoo (FI)
Inventors: ZETTERMAN, Tommi; (FI).
HIRVOLA, Harri; (FI)
Agent: NOKIA TECHNOLOGIES OY; IPR Department Jussi Jaatinen Karakaari 7 FI-02610 Espoo (FI)
Priority Data:
Title (EN) MICROPROCESSOR APPARATUS
(FR) APPAREIL À MICROPROCESSEUR
Abstract: front page image
(EN)A heterogeneous multi-core processor is disclosed which comprises a controller, memory in the formof register files, as well as a local and a global memory, and a plurality of functional units (FUs). The FUs are transport-triggered type units which compute a particular algorithm using a particular data format (e.g. integer or floating point, 8-bit, 16-bit etc.) in response to a move or transfer instruction received at a triggering socket. The controller is configured to compile and execute different kernels in sequence using a Single Instruction Multiple Thread (SIMT) programming paradigm for efficient parallel processing. The controller is further configured to identify the computational and data format requirements of the current kernel, and to configure the core to support the requirements by means of connecting appropriate ones of the FUs to the controller and memory. In the event that a core storing data for use by the current kernel is not itself able to support the kernel's requirements, inter-core communications take place so that an alternative core can process the kernel.
(FR)L'invention concerne un processeur multi-cœur hétérogène, qui comprend un contrôleur, une mémoire sous forme de fichiers de registres, ainsi qu'une mémoire locale et globale, et une pluralité d'unités fonctionnelles (FU). Les FU sont des unités de type déclenchées par transport qui calculent un algorithme particulier en utilisant un format de données particulier (par exemple, entier ou virgule flottante, 8 bits, 16 bits, etc.) en réponse à une instruction de déplacement ou de transfert reçue au niveau d'une douille de déclenchement. Le contrôleur est configuré pour compiler et exécuter différents noyaux en séquence en utilisant un paradigme de programmation Instruction Unique, Multiples Fils d'Exécution (SIMT) pour un traitement parallèle efficace. Le contrôleur est configuré en outre pour identifier les besoins en termes de calcul et de format de données du noyau actuel, et pour configurer le cœur pour supporter les besoins en reliant les FU appropriées parmi les FU au contrôleur et à la mémoire. Dans le cas où un cœur stockant des données destinées à être utilisées par le noyau actuel n'est pas lui-même capable de supporter les besoins du noyau, des communications inter-cœurs ont lieu de telle sorte qu'un autre cœur peut traiter le noyau.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)