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1. (WO2014201717) ACTIVE MATRIX DISPLAY APPARATUS, SCANNING DRIVE CIRCUIT, AND SCANNING DRIVE METHOD THEREFOR
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2014/201717    International Application No.:    PCT/CN2013/078269
Publication Date: 24.12.2014 International Filing Date: 28.06.2013
IPC:
G09G 3/20 (2006.01)
Applicants: SHENZHEN CHINA STAR OPTOELECTRONICS TECHNOLOGY CO., LTD. [CN/CN]; NO.9-2,Tangming Rd, Guangming New District Shenzhen, Guangdong 518132 (CN)
Inventors: GUO, Dongsheng; (CN).
QIN, Hongjiang; (CN)
Agent: CHINA WISPRO INTELLECTUAL PROPERTY LLP.; Room A806 Zhongdi Building, China University of Geosciences Base, No.8 Yuexing 3rd Road, High-Tech Industrial Estate, Nanshan District Shenzhen, Guangdong 518057 (CN)
Priority Data:
201310247245.X 20.06.2013 CN
Title (EN) ACTIVE MATRIX DISPLAY APPARATUS, SCANNING DRIVE CIRCUIT, AND SCANNING DRIVE METHOD THEREFOR
(FR) APPAREIL D'AFFICHAGE À MATRICE ACTIVE, CIRCUIT D'ATTAQUE DE BALAYAGE, ET PROCÉDÉ D'ATTAQUE DE BALAYAGE CORRESPONDANT
(ZH) 主动矩阵显示装置、扫描驱动电路及其扫描驱动方法
Abstract: front page image
(EN)An active matrix display apparatus (20), a scanning drive circuit (23), and a scanning drive method therefor. The scanning drive circuit (23) comprises a time delay module (232). An input end of the time delay module (232) receives an input signal (Vin) integrating an initial clock pulse signal (CKV) and a start pulse signal (STV), and delays the input signal (Vin) in two-part mode, so that a first output end outputs an enabling control signal (OE) and a second output end outputs the time delay clock pulse signal (CKV). By means of the foregoing mode, the number of transmission lines can be reduced, the number of output pins of a time sequence control chip (21) and input pins of a scanning drive chip (231) can be reduced, thereby reducing the cost of chip encapsulation.
(FR)L'invention concerne un dispositif d'affichage à matrice active (20), un circuit d'attaque de balayage (23), et un procédé d'attaque de balayage correspondant. Le circuit d'attaque de balayage (23) comprend un module de temporisation (232). Une extrémité d'entrée du module de temporisation (232) reçoit un signal d'entrée (Vin) intégrant un signal d'impulsion d'horloge (CKV) initial et un signal d'impulsion de démarrage (STV), et retarde le signal d'entrée (Vin) en un mode en deux parties, de sorte qu'une première extrémité de sortie délivre en sortie un signal de commande de validation (OE) et une seconde extrémité de sortie délivre en sortie le signal d'impulsion d'horloge de temporisation (CKV). Grâce au mode qui précède, le nombre de lignes de transmission peut être réduit, le nombre de broches de sortie d'une puce de commande de séquence temporelle (21) et de broches d'entrée d'une puce de commande de balayage (231) peut être réduit, réduisant ainsi le coût de l'encapsulation des puces.
(ZH)一种主动矩阵显示装置(20)、扫描驱动电路(23)及其扫描驱动方法。扫描驱动电路(23)包括延时模块(232),延时模块(232)的输入端接收初始时钟脉冲信号(CKV)和开始脉冲信号(STV)集成的输入信号(Vin),并将输入信号(Vin)进行两部分延时,使得第一输出端输出使能控制信号(OE),第二输出端输出延时时钟脉冲信号(CKV)。通过上述方式,能够减小传输线的数量,同时减少时序控制芯片(21)的输出引脚和扫描驱动芯片(231)的输入引脚的数量,从而降低芯片封装成本。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
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European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: Chinese (ZH)
Filing Language: Chinese (ZH)