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1. (WO2014191838) SYSTEMS AND METHODS FOR DQS GATING
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2014/191838    International Application No.:    PCT/IB2014/001772
Publication Date: 04.12.2014 International Filing Date: 15.05.2014
IPC:
G06F 12/00 (2006.01)
Applicants: MARVELL WORLD TRADE LTD. [BB/BB]; L'horizon, Gunsite Road Brittons Hill St. Michael, BB14027 (BB)
Inventors: ZHU, Jun; (US).
CAO, Joseph, Jun; (US).
CHEN, Shawn; (US)
Agent: SAUER, Joseph, M.; (US)
Priority Data:
61/828,120 28.05.2013 US
61/875,259 09.09.2013 US
Title (EN) SYSTEMS AND METHODS FOR DQS GATING
(FR) SYSTÈMES ET PROCÉDÉS DE PORTILLONNAGE DQS
Abstract: front page image
(EN)Systems and methods for timing read operations with a memory device are provided. A timing signal from the memory device is received at a gating circuit. The timing signal is passed through as a filtered timing signal during a gating window. The gating circuit is configured to open the gating window based on a control signal. The gating circuit is further configured to close the gating window based on a first edge of the timing signal. The first edge is determined based on a counter that is triggered to begin counting by the control signal. At a timing control circuit, the control signal is generated based on i) a count signal from the counter, and ii) a second edge of the timing signal that precedes the first edge in time.
(FR)La présente invention concerne des systèmes et des procédés permettant de temporiser des opérations de lecture avec un dispositif de mémoire. Un signal de temporisation provenant du dispositif de mémoire est reçu au niveau d'un circuit de portillonnage. Le signal de temporisation est transité en tant que signal de temporisation filtré pendant une fenêtre de portillonnage. Le circuit de portillonnage est configuré pour ouvrir la fenêtre de portillonnage sur la base d'un signal de commande. Le circuit de portillonnage est en outre configuré pour fermer la fenêtre de portillonnage sur la base d'une première limite du signal de temporisation. La première limite est déterminée sur la base d'un compteur qui est déclenché par le signal de commande pour commencer à compter. Au niveau d'un circuit de commande de temporisation, le signal de commande est généré sur la base i) d'un signal de décompte provenant du compteur, et ii) d'une seconde limite du signal de temporisation qui précède la première limite dans le temps.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)