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1. (WO2014186445) LOW COMPLEXITY, ADAPTIVE, FRACTIONALLY SPACED EQUALIZER WITH NON-INTEGER SAMPLING
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2014/186445    International Application No.:    PCT/US2014/037974
Publication Date: 20.11.2014 International Filing Date: 14.05.2014
IPC:
H04L 25/03 (2006.01)
Applicants: HUAWEI TECHNOLOGIES CO., LTD. [CN/CN]; Huawei Administration Building Bantian, Longgang District Shenzhen, Guangdong 518129 (CN).
FUTUREWEI TECHNOLOGIES, INC. [US/US]; 5340 Legacy Drive Suite 175 Plano, Texas 75024 (US) (US only)
Inventors: ALI SHAH, Syed Faisal; (CA).
LI, Chuandong; (CA).
ZHANG, Zhuhong; (CA)
Agent: CONLEY ROSE, P.C.; 5601 Granite Parkway Suite 500 Plano, Texas 75024 (US)
Priority Data:
61/823,649 15.05.2013 US
Title (EN) LOW COMPLEXITY, ADAPTIVE, FRACTIONALLY SPACED EQUALIZER WITH NON-INTEGER SAMPLING
(FR) ÉGALISEUR DE FAIBLE COMPLEXITÉ, ADAPTATIF ET À ESPACEMENT FRACTIONNÉ AVEC ÉCHANTILLONNAGE NON ENTIER
Abstract: front page image
(EN)An apparatus comprising a memory and a processor coupled to the memory, wherein the memory includes instructions that when executed by the processor cause the apparatus to perform the following: receive an incoming signal at a sampling rate that is greater than a symbol rate associated with the incoming signal, replicate a plurality of data streams from the incoming signal, apply a plurality of fractional delays to the plurality of data streams correspondingly, generate data blocks from each of the fractionally delayed data streams, and perform an adaptive equalization on each of the data blocks sequentially, wherein the fractional delay is applied to the data streams independently of the adaptive equalization, and wherein the adaptive equalization implements taps spaced at a fraction of a symbol interval associated with the incoming signal.
(FR)L'invention concerne un appareil comprenant une mémoire et un processeur couplé à la mémoire laquelle mémoire comprend des instructions qui, lorsqu'elles sont exécutées par le processeur, amènent l'appareil à effectuer: la réception d'un signal d'entrée à un taux d'échantillonnage qui est supérieur à un débit de symboles associé au signal d'entrée, la reproduction d'une pluralité de flux de données à partir du signal d'entrée, l'application d'une pluralité de retards fractionnels à la pluralité de flux de données, et l'exécution d'une égalisation adaptative sur chacun des multiples blocs de données de manière séquentielle, le retard fractionnel étant appliqué aux flux de données indépendamment de l'égalisation adaptative, laquelle égalisation adaptative met en oeuvre des prélèvements espacés à une fraction d'un intervalle de symbole associé au signal d'entrée.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)