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1. WO2014118985 - BUS MODULE AND BUS SYSTEM

Publication Number WO/2014/118985
Publication Date 07.08.2014
International Application No. PCT/JP2013/052472
International Filing Date 04.02.2013
IPC
G06F 13/00 2006.1
GPHYSICS
06COMPUTING; CALCULATING OR COUNTING
FELECTRIC DIGITAL DATA PROCESSING
13Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
G06F 13/36 2006.1
GPHYSICS
06COMPUTING; CALCULATING OR COUNTING
FELECTRIC DIGITAL DATA PROCESSING
13Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
14Handling requests for interconnection or transfer
36for access to common bus or bus system
CPC
G06F 11/0745
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
11Error detection; Error correction; Monitoring
07Responding to the occurrence of a fault, e.g. fault tolerance
0703Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
0706the processing taking place on a specific hardware platform or in a specific software environment
0745in an input/output transactions management context
G06F 11/0772
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
11Error detection; Error correction; Monitoring
07Responding to the occurrence of a fault, e.g. fault tolerance
0703Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
0766Error or fault reporting or storing
0772Means for error signaling, e.g. using interrupts, exception flags, dedicated error registers
G06F 11/183
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
11Error detection; Error correction; Monitoring
07Responding to the occurrence of a fault, e.g. fault tolerance
16Error detection or correction of the data by redundancy in hardware
18using passive fault-masking of the redundant circuits
183by voting, the voting not being performed by the redundant components
Applicants
  • 三菱電機株式会社 MITSUBISHI ELECTRIC CORPORATION [JP]/[JP] (AllExceptUS)
  • 清水 利彦 SHIMIZU Toshihiko (US)
Inventors
  • 清水 利彦 SHIMIZU Toshihiko
Agents
  • 大岩 増雄 OIWA Masuo
Priority Data
Publication Language Japanese (ja)
Filing Language Japanese (JA)
Designated States
Title
(EN) BUS MODULE AND BUS SYSTEM
(FR) MODULE BUS ET SYSTÈME BUS
(JA) バスモジュール及びバスシステム
Abstract
(EN) A bus module (1) is configured with: an access control unit (30) which performs control of access to a bus (20); an anomaly detection unit (40) which detects an anomaly of a bus module on the basis of a signal from the bus (20); an anomaly detection result storage unit (70) which stores the anomaly detection result data; an anomaly detection communication control unit (60) which outputs an instruction for transmitting the anomaly detection result data to other bus modules (2, 3, …, and n) using predetermined bits of a data line; and an anomaly detection result assessment unit (50) which compares the anomaly detection result data transmitted from the other bus modules (2, 3, …, and n) with the anomaly detection result data stored in the anomaly detection result storage unit (70) of the bus module (1) to assess whether the two are the same or not. As a result, it is possible to achieve simplification of identification of anomalous locations and detailed components within the bus module, as well as improvement of analysis thereof.
(FR) Un module bus (1) selon l'invention est configuré avec : une unité de contrôle d'accès (30) qui réalise un contrôle d'accès à un bus (20); une unité de détection d'anomalie (40) qui détecte une anomalie d'un module bus sur la base d'un signal provenant du bus (20); une unité de stockage de résultat de détection d'anomalie (70) qui stocke les données de résultat de détection d'anomalie; une unité de contrôle de communication de détection d'anomalie (60) qui produit en sortie une instruction pour transmettre les données de résultat de détection d'anomalie à d'autres modules bus (2, 3, …, et n) en utilisant les bits prédéterminés d'une ligne de données; et une unité d'évaluation de résultat de détection d'anomalie (50) qui compare les données de résultat de détection d'anomalie transmises depuis les autres modules bus (2, 3, …, et n) avec les données de résultat de détection d'anomalie stockées dans l'unité de stockage de résultat de détection d'anomalie (70) du module bus (1) pour évaluer si les deux sont identiques ou pas. En conséquence, il est possible de parvenir à une simplification de l'identification d'emplacements anomaux et de composantes détaillées au sein du module bus, ainsi qu'à une amélioration de son analyse.
(JA)  バスモジュール1は、バス20とのアクセスの制御を行うアクセス制御部30と、バス20の信号からバスモジュールの異常を検出する異常検出部40と、異常検出結果データを格納する異常検出結果格納部70と、異常検出結果データをデータ線の所定のビットを使って他のバスモジュール2,3,‥,nに送信する指令を出す異常検出通信制御部60と、他のバスモジュール2,3,‥,nから送信された異常検出結果データと当該バスモジュール1の異常検出結果格納部70に格納されている異常検出結果データとを比較し同一か否か判定する異常検出結果判定部50と、で構成されている。これにより、異常箇所及びバスモジュール内の詳細部位の特定の容易化及び解析性の向上を図ることができる。
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