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1. (WO2013160572) REDUCTION OF THE ELECTRICAL CONSUMPTION OF AN ARRAY OF PROCESSORS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2013/160572    International Application No.:    PCT/FR2013/000111
Publication Date: 31.10.2013 International Filing Date: 23.04.2013
IPC:
G06F 1/32 (2006.01)
Applicants: KALRAY [FR/FR]; 86 rue de Paris F-91400 Orsay (FR)
Inventors: HARRAND, Michel; (FR)
Agent: DE JONG, Jean Jacques; OMNIPAT 24 Place des Martyrs de la Résistance F-13100 Aix en Provence (FR)
Priority Data:
1253755 24.04.2012 FR
Title (EN) REDUCTION OF THE ELECTRICAL CONSUMPTION OF AN ARRAY OF PROCESSORS
(FR) RÉDUCTION DE LA CONSOMMATION ÉLECTRIQUE D'UNE MATRICE DE PROCESSEURS
Abstract: front page image
(EN)The invention relates to a method of execution of a processing on a multiprocessor system (PE) whose clock frequencies are individually adjustable (DIV), comprising the following steps: upon compilation of the source code of the processing, subdividing the processing into elementary tasks (TO) each of which is executable as several occurrences (Oj); dynamically allocating difference processors to successive occurrences of one and the same elementary task; associating with each elementary task a central counter of occurrences (CT), and a threshold (n) of number of occurrences; incrementing the occurrences counter upon the execution of each occurrence of the associated elementary task, independently of the processor allocated to the occurrence; and switching the frequency of the processor allocated to a current occurrence of an elementary task onto a first frequency if the count reached in the associated counter is below the threshold, otherwise switching the frequency of the processor SUT to a second frequency distinct from the first.
(FR)L'invention est relative à un procédé d'exécution d'un traitement sur un système à multiples processeurs (PE) dont les fréquences d'horloge sont réglables individuellement (DIV), comprenant les étapes suivantes : à la compilation du code source du traitement, subdiviser le traitement en tâches élémentaires (TO dont chacune est exécutable en plusieurs occurrences (Oj); allouer dynamiquement des processeurs différents à des occurrences successives d'une même tâche élémentaire; associer à chaque tâche élémentaire un compteur d'occurrences central (CT), et un seuil (n) de nombre d'occurrences; incrémenter le compteur d'occurrences à l'exécution de chaque occurrence de la tâche élémentaire associée, indépendamment du processeur alloué à l'occurrence; et commuter la fréquence du processeur alloué à une occurrence courante d'une tâche élémentaire sur une première fréquence si le compte atteint dans le compteur associé est inférieur au seuil, sinon commuter la fréquence du processeur SUT une deuxième fréquence distincte de la première.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: French (FR)
Filing Language: French (FR)