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1. (WO2013155845) METHOD FOR MANUFACTURING ARRAY SUBSTRATE, ARRAY SUBSTRATE, AND DISPLAY DEVICE
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2013/155845    International Application No.:    PCT/CN2012/085967
Publication Date: 24.10.2013 International Filing Date: 05.12.2012
IPC:
G02F 1/1343 (2006.01), G02F 1/1368 (2006.01)
Applicants: BOE TECHNOLOGY GROUP CO., LTD. [CN/CN]; No.10 Jiuxianqiao Rd., Chaoyang District Beijing 100015 (CN).
HEFEI BOE OPTOELECTRONICS TECHNOLOGY CO., LTD. [CN/CN]; No.2177 Tonglingbei Road Hefei, Anhui 230012 (CN)
Inventors: KIM, Minsu; (CN).
DENG, Liyun; (CN).
ZHOU, Jideng; (CN)
Agent: LIU, SHEN & ASSOCIATES; A0601, Huibin Building, No.8 Beichen Dong Street Chaoyang District Beijing 100101 (CN)
Priority Data:
201210119293.6 20.04.2012 CN
Title (EN) METHOD FOR MANUFACTURING ARRAY SUBSTRATE, ARRAY SUBSTRATE, AND DISPLAY DEVICE
(FR) PROCÉDÉ DE FABRICATION D'UN SUBSTRAT DE MATRICE, SUBSTRAT DE MATRICE, ET DISPOSITIF D'AFFICHAGE
(ZH) 阵列基板的制造方法、阵列基板及显示装置
Abstract: front page image
(EN)Provided are a method for manufacturing an array substrate, the array substrate, and a display device. The array substrate may comprise a display area and a non-display area. The display area comprises a gate line, a data line (8), and multiple pixel units defined by the gate line and by the data line (8). Each pixel unit may comprise a thin-film transistor, a pixel electrode (12), and a common electrode (16). The pixel electrode (12) is connected to a drain electrode (7) of the thin-film transistor. An organic insulating film (10) may be arranged between the pixel electrode (12) and the data line (8). The array substrate is capable of reducing signal delays on the data line (8) in the array substrate and of increasing pixel aperture ratio.
(FR)La présente invention se rapporte à un procédé de fabrication d'un substrat de matrice, à un substrat de matrice et à un dispositif d'affichage. Le substrat de matrice peut comprendre une zone d'affichage et une zone de non-affichage. La zone d'affichage comprend une ligne de grille, une ligne de données (8) et de multiples unités de pixel définies par la ligne de grille et par la ligne de données (8). Chaque unité de pixel peut comprendre un transistor à couches minces, une électrode de pixel (12) et une électrode commune (16). L'électrode de pixel (12) est raccordée à une électrode déversoir (7) du transistor à couches minces. Un film isolant organique (10) peut être agencé entre l'électrode de pixel (12) et la ligne de données (8). Le substrat de matrice peut réduire les retards du signal sur la ligne de données (8) dans le substrat de matrice et augmenter le rapport d'ouverture des pixels.
(ZH)提供了一种阵列基板的制造方法、阵列基板及显示装置。阵列基板可以包括显示区域和非显示区域,显示区域包括栅线、数据线(8)以及由栅线和数据线(8)定义的多个像素单元。每个像素单元可以包括薄膜晶体管、像素电极(12)和公共电极(16),像素电极(12)与薄膜晶体管的漏电极(7)连接。有机绝缘膜(10)可以设置在像素电极(12)和数据线(8)之间。所述阵列基板能够降低阵列基板中数据线(8)上的信号延迟并增大像素的开口率。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: Chinese (ZH)
Filing Language: Chinese (ZH)