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1. (WO2013123427) RESETTABLE VOLTAGE CONTROLLED OSCILLATORS (VCOs) FOR CLOCK AND DATA RECOVERY (CDR) CIRCUITS, AND RELATED SYSTEMS AND METHODS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2013/123427    International Application No.:    PCT/US2013/026488
Publication Date: 22.08.2013 International Filing Date: 15.02.2013
Chapter 2 Demand Filed:    16.12.2013    
IPC:
H04L 7/033 (2006.01), H03L 7/099 (2006.01), H03K 3/03 (2006.01)
Applicants: QUALCOMM INCORPORATED [US/US]; Attn: International IP Administration 5775 Morehouse Drive San Diego, California 92121 (US)
Inventors: ZHUANG, Jingcheng; (US).
DANG, Nam V.; (US)
Agent: TALPALATSKY, Sam; Qualcomm Incorporated 5775 Morehouse Drive San Diego, California 92121-1714 (US)
Priority Data:
61/599,692 16.02.2012 US
13/465,057 07.05.2012 US
Title (EN) RESETTABLE VOLTAGE CONTROLLED OSCILLATORS (VCOs) FOR CLOCK AND DATA RECOVERY (CDR) CIRCUITS, AND RELATED SYSTEMS AND METHODS
(FR) OSCILLATEURS COMMANDÉS EN TENSION (VCO) RÉGLABLES POUR CIRCUITS DE RÉCUPÉRATION D'HORLOGE ET DE DONNÉES (CDR) ET SYSTÈMES ET PROCÉDÉS CORRESPONDANTS
Abstract: front page image
(EN)Clock and data recovery (CDR) circuits and resettable voltage controlled oscillators (VCOs) are disclosed. In one embodiment, the CDR circuit includes a sampler configured to receive a data stream in a data path and sample the data stream. However, a clock signal of the data stream needs to be recovered to sample the data stream since the data stream may not be accompanied by the clock signal. To recover the clock signal from the data stream, the CDR circuit may have a resettable VCO configured to generate a clock output. The sampler and the resettable VCO may be operably associated so that the sampler samples the data stream in the data path based on the clock output. The resettable VCO can be reset to adjust a clock phase of the clock output and help reduce sampling errors resulting from drift of the clock output and/or the data stream.
(FR)L'invention porte sur des circuits de récupération d'horloge et de données (CDR) et sur des oscillateurs commandés en tension (VCO) réglables. Selon un mode de réalisation, le circuit CDR comprend un échantillonneur configuré pour recevoir un flux de données dans un chemin de données et pour échantillonner le flux de données. Toutefois, un signal d'horloge du flux de données doit être récupéré pour échantillonner le flux de données étant donné que le flux de données peut ne pas être accompagné du signal d'horloge. Pour récupérer le signal d'horloge du flux de données, le circuit CDR peut comprendre un VCO réglable configuré pour générer une sortie d'horloge. L'échantillonneur et le VCO réglable peuvent être fonctionnellement associés de telle sorte que l'échantillonneur échantillonne le flux de données dans le chemin de données sur la base de la sortie d'horloge. Le VCO réglable peut être réinitialisé afin d'ajuster une phase d'horloge de la sortie d'horloge et d'aider à réduire des erreurs d'échantillonnage résultant d'une dérive de la sortie d'horloge et/ou du flux de données.
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Publication Language: English (EN)
Filing Language: English (EN)