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Pub. No.:    WO/2013/112701    International Application No.:    PCT/US2013/022914
Publication Date: 01.08.2013 International Filing Date: 24.01.2013
H04L 7/04 (2006.01)
Applicants: TEXAS INSTRUMENTS INCORPORATED [US/US]; P.O. Box 655474 Mail Station 3999 Dallas, TX 75265-5474 (US).
TEXAS INSTRUMENTS JAPAN LIMITED [JP/JP]; 24-1, Nishi-Shinjuku 6-chome Shinjuku-ku Tokyo 160-8366 (JP) (JP only)
Inventors: MUKHERJEE, Tonmoy, S.; (US).
AUDE, Arlo, J.; (US)
Agent: FRANZ, Warren, L.; Texas Instruments Incorporated P.O. Box 655474, Mail Station 3999 Dallas, TX 75265-5474 (US)
Priority Data:
61/590,097 24.01.2012 US
13/746,075 21.01.2013 US
Abstract: front page image
(EN)The disclosed clock-data recovery architecture includes out-of-lock (including false lock) detection. A clock-data recovery (CDR) circuit (100) for out-of-lock (including false lock) detection includes a phase/frequency detector (PFD) (101) for clock recovery and a data retimer (111) for recovering/retiming data. A received data signal is input to phase/frequency detector (101), which generates a recovered clock, and to retimer (111) which recovers and retimes data based on the recovered clock. Out-of-lock detection is accomplished by sampling retimed/recovered data with positive and negative edges of the received data. In example embodiments, an out-of-lock condition is determined either by detecting the occurrence of, or counting, missed edges corresponding to the failure of received data sampling to detect corresponding positive/negative edges of the retimed/recovered data.
(FR)La présente invention se rapporte à une architecture de récupération de données d'horloge comprenant une détection hors verrouillage (y compris un faux verrouillage). Selon la présente invention, un circuit de récupération de données d'horloge (CDR) (100) pour une détection hors verrouillage (y compris un faux verrouillage) comprend : un détecteur de phase/de fréquence (PFD) (101) pour la récupération d'une horloge ; et un circuit de resynchronisation de données (111) pour la récupération et la resynchronisation de données. Un signal de données reçu est entré : dans le détecteur de phase/de fréquence (101), qui génère une horloge récupérée ; et dans le circuit de resynchronisation de données (111), qui récupère et qui resynchronise des données sur la base de l'horloge récupérée. Une détection hors verrouillage est accomplie via un échantillonnage de données récupérées et resynchronisées avec des bords positif et négatif des données reçues. Dans des modes de réalisation fournis à titre d'exemple de la présente invention, une condition hors verrouillage est déterminée, soit en détectant la survenue de bords manqués soit en comptant des bords manqués qui correspondent à l'échec de l'échantillonnage des données reçues, dans le but de détecter des bords positif et négatif correspondants des données qui ont été récupérées et resynchronisées.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)