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1. (WO2013057864) NONVOLATILE STORAGE DEVICE, CONTROL METHOD THEREFOR, MEMORY CONTROLLER, SET SYSTEM PROVIDED WITH NONVOLATILE STORAGE DEVICE, AND CONTROL METHOD THEREFOR
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2013/057864    International Application No.:    PCT/JP2012/005390
Publication Date: 25.04.2013 International Filing Date: 28.08.2012
IPC:
G06F 12/16 (2006.01)
Applicants: PANASONIC CORPORATION [JP/JP]; 1006, Oaza Kadoma, Kadoma-shi, Osaka 5718501 (JP) (For All Designated States Except US).
HIRANO, Takehisa; (For US Only).
SAKAI, Keisuke; (For US Only).
TANAKA, Takayuki; (For US Only).
MIZUSHIMA, Miki; (For US Only)
Inventors: HIRANO, Takehisa; .
SAKAI, Keisuke; .
TANAKA, Takayuki; .
MIZUSHIMA, Miki;
Agent: MAEDA & PARTNERS; Osaka-Marubeni Bldg.5F, 5-7,Hommachi 2-chome, Chuo-ku, Osaka-shi, Osaka 5410053 (JP)
Priority Data:
2011-227807 17.10.2011 JP
Title (EN) NONVOLATILE STORAGE DEVICE, CONTROL METHOD THEREFOR, MEMORY CONTROLLER, SET SYSTEM PROVIDED WITH NONVOLATILE STORAGE DEVICE, AND CONTROL METHOD THEREFOR
(FR) DISPOSITIF DE STOCKAGE NON VOLATIL, SON PROCÉDÉ DE COMMANDE, CONTRÔLEUR DE MÉMOIRE, SYSTÈME CONFIGURÉ COMPORTANT UN DISPOSITIF DE STOCKAGE NON VOLATIL, ET SON PROCÉDÉ DE COMMANDE
(JA) 不揮発性記憶装置及びその制御方法、メモリーコントローラ、並びに不揮発性記憶装置を備えたセットシステム及びその制御方法
Abstract: front page image
(EN)A nonvolatile storage device (1) is provided with a nonvolatile storage element (20) having a plurality of storage blocks, and a memory controller (10). The memory controller (10) is provided with an interface unit (14) which executes multiple write processing in a write operation and reads a plurality of data rows written by the multiple write processing in a read operation, and a correction unit (40) which detects the presence or absence of a difference bit at the same bit position of the plurality of data rows read by the interface unit (14), and corrects the bit values of the difference bit on the basis of a predetermined standard.
(FR)L'invention concerne un dispositif de stockage non volatil (1) qui comporte un élément de stockage non volatil (20) ayant une pluralité de blocs de stockage, et un contrôleur de mémoire (10). Le contrôleur de mémoire (10) comporte une unité d'interface (14) qui exécute de multiples traitements d'écriture dans une opération d'écriture et lit une pluralité de rangées de données écrites par les multiples traitements d'écriture dans une opération de lecture, et une unité de correction (40) qui détecte la présence ou l'absence d'un bit de différence à la même position de bit de la pluralité de rangées de données lues par l'unité d'interface (14), et corrige les valeurs de bit du bit de différence sur la base d'une norme prédéterminée.
(JA) 不揮発性記憶装置(1)は、複数の記憶ブロックを有する不揮発性記憶素子(20)とメモリーコントローラ(10)とを備えている。メモリーコントローラ(10)は、書き込み動作において多重書き込み処理を実行し、読み出し動作において多重書き込み処理によって書き込まれた複数のデータ列を読み出すインターフェース部(14)と、インターフェース部(14)によって読み出された複数のデータ列の同一ビット位置における差異ビットの有無を検出し、差異ビットにおけるビット値を予め定められた基準に基づいて修正する修正部(40)とを備えている。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)