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1. (WO2012115880) DELAY CELL FOR CLOCK SIGNALS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2012/115880    International Application No.:    PCT/US2012/025695
Publication Date: 30.08.2012 International Filing Date: 17.02.2012
IPC:
H03K 5/13 (2006.01)
Applicants: QUALCOMM INCORPORATED [US/US]; Attn: International Ip Administration 5775 Morehouse Drive San Diego, CA 92121 (US) (For All Designated States Except US).
QUAN, Xiaohong [CN/US]; (US) (For US Only).
SRIVASTAVA, Ankit [IN/US]; (US) (For US Only)
Inventors: QUAN, Xiaohong; (US).
SRIVASTAVA, Ankit; (US)
Agent: HO, Eric; Attn: International Ip Administration 5775 Morehouse Drive San Diego, California 92121 (US)
Priority Data:
13/032,326 22.02.2011 US
Title (EN) DELAY CELL FOR CLOCK SIGNALS
(FR) CELLULE DE RETARD POUR SIGNAUX D'HORLOGE
Abstract: front page image
(EN)An integrated circuit for delaying a clock signal using a delay cell is described. The integrated circuit includes a current starved inverter. The current starved inverter includes a switched capacitor current source with a first dummy inverter, a first amplifier coupled to the first dummy inverter and a first capacitor coupled to the first amplifier via a first switch. The current starved inverter also includes a first transistor coupled to the current source. The integrated circuit also includes a second capacitor. A delay applied to the clock signal is dependent on a ratio between the first capacitor and the second capacitor. The first capacitor and the second capacitor may be located in proximity such that process, voltage and temperature variations affect the first capacitor and the second capacitor similarly and the delay applied to the clock signal is independent of process, voltage and temperature variations
(FR)L'invention concerne un circuit intégré conçu pour retarder un signal d'horloge au moyen d'une cellule de retard. Le circuit intégré comprend un inverseur appauvri en courant. L'inverseur appauvri en courant comprend une source de courant de condensateur commutée dotée d'un premier inverseur factice, d'un premier amplificateur couplé au premier inverseur factice et d'un premier condensateur couplé au premier amplificateur par le biais d'un premier commutateur. L'inverseur appauvri en courant comprend également un premier transistor couplé à la source de courant. Le circuit intégré comprend également un second condensateur. Un retard appliqué au signal d'horloge dépend d'un rapport entre le premier condensateur et le second condensateur. Le premier condensateur et le second condensateur peuvent être situés à proximité de telle sorte que les variations de procédé, de tension et de température affectent le premier condensateur et le second condensateur de manière similaire et que le retard appliqué au signal d'horloge est indépendant des variations de procédé, de tension et de température.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)