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1. (WO2012111848) MIXER CIRCUIT
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2012/111848    International Application No.:    PCT/JP2012/054336
Publication Date: 23.08.2012 International Filing Date: 16.02.2012
IPC:
H03D 7/14 (2006.01), H03D 7/00 (2006.01), H03D 7/12 (2006.01)
Applicants: NEC CORPORATION [JP/JP]; 7-1,Shiba 5-chome, Minato-ku, Tokyo 1088001 (JP) (For All Designated States Except US).
KISHIMOTO, Shuya [JP/JP]; (JP) (For US Only)
Inventors: KISHIMOTO, Shuya; (JP)
Agent: SHIMOSAKA, Naoki; c/o NEC CORPORATION, 7-1,Shiba 5-chome, Minato-ku, Tokyo 1088001 (JP)
Priority Data:
2011-031046 16.02.2011 JP
Title (EN) MIXER CIRCUIT
(FR) CIRCUIT MÉLANGEUR
(JA) ミキサ回路
Abstract: front page image
(EN)Provided is a mixer circuit, comprising: a differential motion amplifier (10) which is configured of a one-stage differential motion amplifier transistor pair (111, 112), wherein a first differential motion signal is inputted, and the first differential motion signal is amplified and outputted via first matching circuits (121, 122); a multiplier (20), which is configured of one-stage differential motion switching transistor pairs (211, 212, 213, 214), wherein a second differential motion signal, and the first differential motion signal which the differential motion amplifier has amplified and outputted, are inputted, the first differential motion signal being inputted via second matching circuits (221, 222), the second differential motion signal and the first differential motion signal which the differential motion amplifier has amplified and outputted are multiplied and outputted as a third differential motion signal; and a capacitance coupling unit (30) which connects the first matching circuits of the differential motion amplifier and the second matching circuits of the multiplier, and galvanically isolates the differential motion amplifier and the multiplier. Power is supplied to the differential motion amplifier transistor pair of the differential motion amplifier and the differential motion switching transistor pairs of the multiplier in isolation from one another, thus providing a mixer circuit which operates at low voltage and has strong power saturation and conversion gain.
(FR)La présente invention concerne un circuit mélangeur comprenant : un amplificateur de mouvement différentiel (10) qui est composé d'une paire de transistors d'amplificateur de mouvement différentiel à un étage (111, 112), un premier signal de mouvement différentiel étant entré, et le premier signal de mouvement différentiel étant amplifié et sorti par le biais de premiers circuits d'adaptation (121, 122) ; d'un multiplicateur (20) qui est composé de paires de transistors d'amplificateur de mouvement différentiel à un étage (211, 212, 213, 214), un deuxième signal de mouvement différentiel et le premier signal de mouvement différentiel que l'amplificateur de mouvement différentiel a amplifié et sorti étant entrés, le premier signal de mouvement différentiel étant entré en passant par des seconds circuits d'adaptation (221, 222), le deuxième signal de mouvement différentiel et le premier signal de mouvement différentiel que l'amplificateur de mouvement différentiel a amplifié et sorti étant multipliés et sortis sous la forme d'un troisième signal de mouvement différentiel ; et d'une unité de couplage de capacité (30) qui connecte les premiers circuits d'adaptation de l'amplificateur de mouvement différentiel et les seconds circuits d'adaptation du multiplicateur, et forme une isolation galvanique entre l'amplificateur de mouvement différentiel et le multiplicateur. Une énergie est fournie à la paire de transistors de l'amplificateur de mouvement différentiel et aux paires de transistors de commutation de mouvement différentiel isolés les uns des autres, ce qui forme un circuit mélangeur qui fonctionne à basse tension et présente une saturation de puissance élevée et un gain de conversion élevé.
(JA)1段の差動増幅トランジスタペア(111,112)で構成され,第1の差動信号を入力して第1の差動信号を増幅し,第1の整合回路(121,122)を介して出力する差動増幅器(10)と,1段の差動スイッチングトランジスタペア(211,212,213,214)で構成され,第2の差動信号と,第2の整合回路(221,222)を介して差動増幅器が増幅出力した第1の差動信号を入力し,第2の差動信号と差動増幅器が増幅出力した第1の差動信号を乗算して第3の差動信号として出力する乗算器(20)と,差動増幅器の第1の整合回路と乗算器の第2の整合回路を接続し,差動増幅器と乗算器とを直流的に分離する容量結合部(30)とを備え,差動増幅器の差動増幅トランジスタペアと乗算器の差動スイッチングトランジスタペアは,それぞれ独立して電源が供給することにより,低電圧で動作し,飽和電力と変換利得が高いミキサ回路を提供する。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)