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1. (WO2012106719) PROCESSOR WITH A COPROCESSOR HAVING EARLY ACCESS TO NOT-YET ISSUED INSTRUCTIONS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2012/106719    International Application No.:    PCT/US2012/023998
Publication Date: 09.08.2012 International Filing Date: 06.02.2012
IPC:
G06F 9/38 (2006.01)
Applicants: QUALCOMM INCORPORATED [US/US]; Attn: International Ip Administration 5775 Morehouse Drive San Diego, CA 92121 (US) (For All Designated States Except US).
DOCKSER, Kenneth Alan [US/US]; (US) (For US Only).
TEKMEN, Yusuf Cagatay [US/US]; (US) (For US Only)
Inventors: DOCKSER, Kenneth Alan; (US).
TEKMEN, Yusuf Cagatay; (US)
Agent: PAULEY, Nicholas J.; 5775 Morehouse Drive San Diego, CA 92121 (US)
Priority Data:
61/439,608 04.02.2011 US
13/363,541 01.02.2012 US
Title (EN) PROCESSOR WITH A COPROCESSOR HAVING EARLY ACCESS TO NOT-YET ISSUED INSTRUCTIONS
(FR) PROCESSEUR ÉQUIPÉ D'UN COPROCESSEUR AYANT PRÉMATURÉMENT ACCÈS À DES INSTRUCTIONS NON ENCORE DÉLIVRÉES
Abstract: front page image
(EN)Apparatus and methods provide early access of instructions. A fetch queue is coupled to an instruction cache and configured to store a mix of processor instructions for a first processor and coprocessor instructions for a second processor. A coprocessor instruction selector is coupled to the fetch queue and configured to copy coprocessor instructions from the fetch queue. A queue is coupled to the coprocessor instruction selector and from which coprocessor instructions are accessed for execution before the coprocessor instruction is issued to the first processor. Execution of the copied coprocessor instruction is started in the coprocessor before the coprocessor instruction is issued to a processor. The execution of the copied coprocessor instruction is completed based on information received from the processor after the coprocessor instruction has been issued to the processor.
(FR)Un appareil et des procédés permettent un accès prématuré à des instructions. Une file d'attente de récupération couplée à une mémoire cache d'instructions est conçue pour stocker un lot d'instructions de processeur destinées à un premier processeur et d'instructions de coprocesseur destinées à un second processeur. Un sélecteur d'instructions de coprocesseur couplé à la file d'attente de récupération est conçu pour copier les instructions de coprocesseur à partir de la file d'attente de récupération. Une file d'attente couplée au sélecteur d'instructions de coprocesseur permet d'accéder aux instructions de coprocesseur à des fins d'exécution avant que l'instruction de coprocesseur ne soit délivrée au premier processeur. L'exécution de l'instruction de coprocesseur copiée est commencée dans le coprocesseur avant que l'instruction de coprocesseur ne soit délivrée à un processeur. L'exécution de l'instruction de coprocesseur copiée est achevée sur la base des informations reçues en provenance du processeur après que l'instruction de coprocesseur a été délivrée au processeur.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)