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1. (WO2012100853) METHOD FOR REGULATING A BUCK/BOOST CONVERTER
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2012/100853    International Application No.:    PCT/EP2011/069741
Publication Date: 02.08.2012 International Filing Date: 09.11.2011
IPC:
H02M 3/158 (2006.01)
Applicants: SIEMENS AKTIENGESELLSCHAFT [DE/DE]; Wittelsbacherplatz 2 80333 München (DE) (For All Designated States Except US).
HALLAK, Jalal [AT/AT]; (AT) (For US Only)
Inventors: HALLAK, Jalal; (AT)
Common
Representative:
SIEMENS AKTIENGESELLSCHAFT; Postfach 22 16 34 80506 München (DE)
Priority Data:
11152043.3 25.01.2011 EP
Title (DE) VERFAHREN ZUR REGELUNG EINES TIEF-HOCHSETZSTELLERS
(EN) METHOD FOR REGULATING A BUCK/BOOST CONVERTER
(FR) PROCÉDÉ DE RÉGULATION D'UN CONVERTISSEUR ABAISSEUR-ÉLÉVATEUR
Abstract: front page image
(DE)Die Erfindung betrifft ein Verfahren zur Regelung eines getakteten Tief-Hochsetzstellers, wobei mit einer gemeinsamen Taktfrequenz ein Tiefsetzer-Schaltelement (S1) mit einem ersten pulsweitenmodulierten Schaltsignal (SigS1) angesteuert wird und ein Hochsetzer-Schaltelement (S2) mit einem zweiten pulsweitenmodulierten Schaltsignal (SigS2) angesteuert wird, zur Umwandlung einer Eingangsspannung (UIN) in eine geregelte Ausgangsspannung (UOUT), wobei ein Reglersignal (UREG) eines Ausgangsspannungsreglers (REG) zur Erzeugung der pulsweitenmodulierten Schaltsignale (SigS1, SigS2) verwendet wird. Dabei wird der Tief-Hochsetzsteller in einem diskontinuierlichen Modus mit quasiresonatem Schalten betrieben, wobei der Drosselstrom (iL) oder der Strom durch das Tiefsetzer-Schaltelement (S1) erfasst und mit einem Referenzstrom (IRef) verglichen wird, wobei das Reglersignal (UREG) in dem Ausmaß verstärkt wird, in dem die Erreichung des Referenzstromes (lRef) zeitlich vor einem Abschaltimpuls des ersten pulsweitenmodulierten Schaltsignals (SigS1) auftritt und wobei mittels des verstärkten Reglersignals (UV) das zweite pulsweitenmodulierte Schaltsignal (SigS2) erzeugt wird.
(EN)The invention relates to a method for regulating a clocked buck/boost converter, wherein a buck converter switching element (S1) is driven at a common clock frequency with a first pulse-width-modulated switching signal (SigS1) and a boost converter switching element (S2) is driven with a second pulse-width-modulated switching signal (SigS2) in order to convert an input voltage (UIN) into a regulated output voltage (UOUT), wherein a regulator signal (UREG) from an output voltage regulator (REG) is used to generate the pulse-width-modulated switching signals (SigS1, SigS2). In this case, the buck converter is operated in a discontinuous mode with quasi-resonant switching, wherein the inductor current (iL) or the current through the buck converter switching element (S1) is detected and is compared with a reference current (IRef), wherein the regulator signal (UREG) is amplified to the extent that the reference current (IRef) is reached, in terms of time, before a turn-off pulse of the first pulse-width-modulated switching signal (SigS1), and wherein the second pulse-width-modulated switching signal (SigS2) is generated using the amplified regulator signal (UV).
(FR)L'invention concerne un procédé de régulation d'un convertisseur abaisseur-élévateur cadencé. Avec une fréquence d'horloge commune, un élément de commutation abaisseur (S1) est commandé au moyen d'un premier signal de commutation modulé en largeur d'impulsion (SigS1) et un élément de commutation élévateur (S2) est commandé au moyen d'un deuxième signal de commutation modulé en largeur d'impulsion (SigS2) pour convertir une tension d'entrée (UIN) en une tension de sortie régulée (UOUT), un signal de régulation (UREG) d'un régulateur de tension de sortie (REG) étant utilisé pour générer les signaux de commutation modulés en largeur d'impulsion (SigS1, SigS2). Selon l'invention, le convertisseur abaisseur-élévateur fonctionne selon un mode discontinu à commutation quasi résonnante, le courant de la bobine de choc (iL) ou le courant circulant dans l'élément de commutation abaisseur (S1) est détecté et comparé avec un courant de référence (IRef), le signal de régulation (UREG) est amplifié de sorte que le courant de référence (lRef) soit atteint avant une impulsion de coupure du premier signal de commutation modulé en largeur d'impulsion (SigS1), et le deuxième signal de commutation modulé en largeur d'impulsion (SigS2) est généré au moyen du signal de régulation amplifié (UV).
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: German (DE)
Filing Language: German (DE)