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1. (WO2012100183) DRIVING CIRCUITRY FOR LED LIGHTING WITH REDUCED TOTAL HARMONIC DISTORTION
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2012/100183    International Application No.:    PCT/US2012/022059
Publication Date: 26.07.2012 International Filing Date: 20.01.2012
IPC:
H05B 37/00 (2006.01)
Applicants: ONCE INNOVATIONS INC. [US/US]; 5455 Highway 169N Plymouth, MN 55442 (US) (For All Designated States Except US).
GRAJCAR, Zdenko [SK/US]; (US) (For US Only)
Inventors: GRAJCAR, Zdenko; (US)
Agent: BECKER, Stephen, A.; McDermott Will & Emery LLP 600 13th Street NW Washington, DC 20005-3096 (US)
Priority Data:
61/435,258 21.01.2011 US
Title (EN) DRIVING CIRCUITRY FOR LED LIGHTING WITH REDUCED TOTAL HARMONIC DISTORTION
(FR) CIRCUITERIE D'ATTAQUE POUR ÉCLAIRAGE À DEL À DISTORSION HARMONIQUE TOTALE RÉDUITE
Abstract: front page image
(EN)Conditioning circuits are provided for driving two or more LED groups using a rectified AC input voltage. The conditioning circuits uses analog circuitry to gradually and selectively activate the LED groups based on an instantaneous value of the rectified input voltage. The circuit includes a first series interconnection of a first LED group, a first transistor, and a first resistor, and a second series interconnection of a second LED group, a second transistor, and a second resistor. In one example, the second series interconnection is connected between a drain terminal and a source terminal of the first transistor, while in another example, the second series interconnection is connected between an anode of the first LED group and a source terminal of the first transistor. The first and second LED groups are selectively activated by the rectified voltage applied across the first series interconnection.
(FR)Selon l'invention, des circuits de conditionnement sont utilisés pour attaquer deux groupes de diodes électroluminescentes (DEL) ou plus à l'aide d'une tension d'entrée alternative redressée. Les circuits de conditionnement utilisent une circuiterie analogique pour activer progressivement et sélectivement les groupes de DEL sur la base d'une valeur instantanée de la tension d'entrée redressée. Le circuit comprend une première interconnexion en série d'un premier groupe de DEL, d'un premier transistor et d'une première résistance, et une seconde interconnexion en série d'un second groupe de DEL, d'un second transistor et d'une seconde résistance. Selon un exemple, la seconde interconnexion en série est connectée entre une borne de drain et une borne de source du premier transistor, tandis que selon un autre exemple, la seconde interconnexion en série est connectée entre une anode du premier groupe de DEL et une borne de source du premier transistor. Les premier et second groupes de DEL sont sélectivement activés par la tension redressée appliquée aux bornes de la première interconnexion en série.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)