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1. (WO2012098984) DATA-PROCESSING DEVICE AND DATA-PROCESSING METHOD
Latest bibliographic data on file with the International Bureau   

Pub. No.: WO/2012/098984 International Application No.: PCT/JP2012/050463
Publication Date: 26.07.2012 International Filing Date: 12.01.2012
IPC:
H03M 13/19 (2006.01) ,H04L 27/00 (2006.01)
Applicants: SHINOHARA Yuji[JP/JP]; JP (UsOnly)
YAMAMOTO Makiko[JP/JP]; JP (UsOnly)
SONY CORPORATION[JP/JP]; 1-7-1, Konan, Minato-ku, Tokyo 1080075, JP (AllExceptUS)
Inventors: SHINOHARA Yuji; JP
YAMAMOTO Makiko; JP
Agent: INAMOTO Yoshio; Nishishinjukukimuraya Building 9F, 5-25, Nishi-Shinjuku 7-chome, Shinjuku-ku, Tokyo 1600023, JP
Priority Data:
2011-00875419.01.2011JP
Title (EN) DATA-PROCESSING DEVICE AND DATA-PROCESSING METHOD
(FR) DISPOSITIF DE TRAITEMENT DE DONNÉES ET PROCÉDÉ DE TRAITEMENT DE DONNÉES
(JA) データ処理装置、及び、データ処理方法
Abstract: front page image
(EN) This technology relates to a data-processing device and data-processing method having increased tolerance for data errors. With an LDPC code mapped to 64 signal points, said LDPC code having a block size of 16,200 bits and a code rate of 1/5, 2/5, 4/9, 7/15, 3/5, or 2/3, a demultiplexer performs the following rearrangement, with "bi" representing the (i+1)th of 6×2 code bits and "yi" representing the (i+1)th of 6×2 symbol bits for two consecutive symbols, counting in both cases from the most significant bit: b0 to y2, b1 to y8, b2 to y4, b3 to y11, b4 to y0, b5 to y10, b6 to y1, b7 to y9, b8 to y5, b9 to y7, b10 to y3, and b11 to y6. The present invention can be applied, for example, to a transmission system for transmitting LDPC codes.
(FR) La technologie de la présente invention porte sur un dispositif de traitement de données et un procédé de traitement de données ayant une tolérance accrue aux erreurs de données. A l'aide d'un code LDPC mappé à 64 points de signal, ledit code LDPC ayant une taille de bloc de 16 200 bits et un rendement de codage de 1/5, 2/5, 4/9, 7/15, 3/5 ou 2/3, un démultiplexeur effectue le réagencement suivant, « bi » représentant le (i+1)ième bit de 6×2 bits de code et « yi » représentant le (i+1)ième bit de 6×2 bits de symbole pour deux symboles consécutifs, en comptant dans les deux cas à partir du bit de poids le plus fort : de b0 à y2, de b1 à y8, de b2 à y4, de b3 à y11, de b4 à y0, de b5 à y10, de b6 à y1, de b7 à y9, de b8 à y5, de b9 à y7, de b10 à y3, et de b11 à y6. La présente invention peut être appliquée, par exemple, à un système de transmission servant à transmettre des codes LDPC.
(JA) 本技術は、データのエラーに対する耐性を向上させることができるデータ処理装置、及び、データ処理方法に関する。 符号長が16200ビットのLDPC符号が、64個の信号点にマッピングされる場合に、デマルチプレクサは、6×2ビットの符号ビットと、連続する2個のシンボルの6×2ビットのシンボルビットの最上位ビットから#i+1ビット目を、それぞれ、ビットb#iとy#iとすると、符号化率が1/5,2/5,4/9,7/15,3/5,2/3のLDPC符号について、b0をy2に、b1をy8に、b2をy4に、b3をy11に、b4をy0に、b5をy10に、b6をy1に、b7をy9に、b8をy5に、b9をy7に、b10をy3に、b11をy6に、それぞれ割り当てる入れ替えを行う。本発明は、例えば、LDPC符号を伝送する伝送システム等に適用できる。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
African Regional Intellectual Property Organization (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Office (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG)
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)