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Pub. No.:    WO/2012/095980    International Application No.:    PCT/JP2011/050474
Publication Date: 19.07.2012 International Filing Date: 13.01.2011
G06F 12/00 (2006.01)
Applicants: FUJITSU LIMITED [JP/JP]; 1-1, Kamikodanaka 4-chome, Nakahara-ku, Kawasaki-shi, Kanagawa 2118588 (JP) (For All Designated States Except US).
SAKAMAKI, Hideyuki [JP/JP]; (JP) (For US Only).
OSANO, Hidekazu [JP/JP]; (JP) (For US Only).
NAKAYAMA, Hiroshi [JP/JP]; (JP) (For US Only).
TAKAKU, Kazuya [JP/JP]; (JP) (For US Only).
HIGETA, Masanori [JP/JP]; (JP) (For US Only)
Inventors: SAKAMAKI, Hideyuki; (JP).
OSANO, Hidekazu; (JP).
NAKAYAMA, Hiroshi; (JP).
TAKAKU, Kazuya; (JP).
HIGETA, Masanori; (JP)
Agent: ITOH, Tadahiko; 16th Floor, Marunouchi MY PLAZA (Meiji Yasuda Seimei Building), 1-1, Marunouchi 2-chome, Chiyoda-ku, Tokyo 1000005 (JP)
Priority Data:
(JA) メモリコントローラ、及び情報処理装置
Abstract: front page image
(EN)The objective of the present invention is to provide a memory controller and information processing device which are capable of accurately performing addressing and reading and writing of data even for any of DIMMs with different address line topologies, and in which manufacturing cost is suppressed. The memory controller includes an assessment unit that classifies DIMMs, which have different address line topologies, by type on the basis of an SPD, a slew rate setting unit for setting the slew rate for an address signal according to the type of DIMM assessed by the assessment unit, and a delay setting unit for setting a data delay amount for read time or write time of data according to the type of DIMM which has been classified by the assessment unit.
(FR)L'invention concerne un contrôleur de mémoire et un dispositif de traitement d'informations capables d'effectuer de manière précise l'adressage, la lecture et l'écriture de données même dans le cas de mémoires DIMM quelconques ayant des topologies de lignes d'adresses différentes, et permettant de réduire les coûts de fabrication. Le contrôleur de mémoire comprend une unité d'évaluation qui classe les mémoires DIMM ayant des topologies de lignes d'adresses différentes selon leur type sur la base d'une détection de présence série (SPD, Serial Presence Detect), une unité de réglage de la vitesse de saut permettant de régler la vitesse de saut d'un signal d'adresse en fonction du type de la mémoire DIMM évaluée par l'unité d'évaluation, et une unité de réglage de retard destinée à régler la valeur d'un retard de données correspondant au temps de lecture ou au temps d'écriture des données en fonction du type de la mémoire DIMM ayant été classée par l'unité d'évaluation.
(JA) アドレス線のトポロジーの異なるいずれのDIMMに対してもアドレス指定とデータの読み書きを正確に行うことができるとともに、製造コストを抑制したメモリコントローラ及び情報処理装置を提供することを課題とする。 アドレス線のトポロジーが異なるDIMMの種類をSPDに基づいて判定する判定部と、 前記判定部によって判定されるDIMMの種類に応じて、アドレス信号のスルーレートを設定するスルーレート設定部と、 前記判定部によって判定されるDIMMの種類に応じて、データの読み出し時又は書き込み時のデータ遅延量を設定する遅延設定部と を含む、メモリコントローラ。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)