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1. (WO2012088625) PHASE-FREQUENCY DETECTION METHOD
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2012/088625    International Application No.:    PCT/CN2010/002190
Publication Date: 05.07.2012 International Filing Date: 29.12.2010
IPC:
H03L 7/087 (2006.01)
Applicants: TELEFONAKTIEBOLAGET L M ERICSSON (publ) [SE/SE]; S-164 83 Stockholm (SE) (For All Designated States Except US).
WEN, Steven [CN/CN]; (CN) (For US Only)
Inventors: WEN, Steven; (CN)
Agent: CHINA PATENT AGENT (H.K.) LTD.; 22/F, Great Eagle Centre 23 Harbour Road, Wanchai Hong Kong (CN)
Priority Data:
Title (EN) PHASE-FREQUENCY DETECTION METHOD
(FR) PROCÉDÉ DE DÉTECTION DE PHASE-DE FRÉQUENCE
Abstract: front page image
(EN)The present invention relates to a method and device for phase-frequency detection in a phase-lock loop circuit. This is provided in a method for detecting phase/frequency error in a digital phase-locked loop, PLL. The method comprises receiving (301, 302) compare edge of a reference clock signal and compare edge of a feedback clock signal, maintaining (304) a phase/frequency detector, PFD, state machine with three PFD states, UP (502), DOWN (503), and IDLE (501), based on the received compare edges of the reference and feedback clock signals, recording current and previous time the state machine stays in UP or DOWN states, generating an UP or DOWN signal based on transition of PFD states and the comparison between recorded current time and recorded previous time; and outputting a digital control signal to a feedback frequency control device (105) based on the UP or DOWN signal. The present invention also relates to a device and system arranged to execute the method according to the present invention.
(FR)La présente invention se rapporte à un procédé et à un dispositif de détection de phase-de fréquence dans un circuit à boucle à verrouillage de phase. Ceci est mis en œuvre dans un procédé destiné à détecter une erreur de phase/de fréquence dans une boucle à verrouillage de phase numérique, PLL. Le procédé comprend les étapes consistant à : recevoir (301, 302) un bord de comparaison d'un signal d'horloge de référence et un bord de comparaison d'un signal d'horloge de rétroaction ; mettre à jour (304) une machine d'état de détecteur de phase/de fréquence, PFD, avec trois états de PFD, HAUT (502), BAS (503) et INACTIF (501), sur la base des bords de comparaison reçus des signaux d'horloge de référence et de rétroaction ; enregistrer l'instant actuel et l'instant précédent où la machine d'état reste dans les états HAUT ou BAS ; générer un signal HAUT ou BAS sur la base de la transition des états de PFD et de la comparaison entre l'instant actuel enregistré et l'instant précédent enregistré ; et délivrer en sortie un signal de commande numérique à un dispositif de commande de fréquence de rétroaction (105) sur la base du signal HAUT ou BAS. La présente invention se rapporte également à un dispositif et à un système agencés de façon à exécuter le procédé selon la présente invention.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)