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1. (WO2012054162) INTELLIGENT ARCHITECTURE CREATOR
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2012/054162    International Application No.:    PCT/US2011/052215
Publication Date: 26.04.2012 International Filing Date: 19.09.2011
IPC:
G06F 17/50 (2006.01)
Applicants: ALGOTOCHIP CORPORATION [US/US]; 530 Lakeside Drive, Suite 260 Sunnyvale, CA 94085-4064 (US) (For All Designated States Except US).
PANDURANGAN, Anand [IN/IN]; (IN) (For US Only).
NG, Pius [US/US]; (US) (For US Only).
SELVARAJ, Siva [IN/US]; (US) (For US Only).
BANERJEE, Sanjay [US/US]; (US) (For US Only).
DURBHA, Ananth [US/US]; (US) (For US Only).
KADIYALA, Suresh [US/US]; (US) (For US Only).
PADMANABHAN, Satish [US/US]; (US) (For US Only)
Inventors: PANDURANGAN, Anand; (IN).
NG, Pius; (US).
SELVARAJ, Siva; (US).
BANERJEE, Sanjay; (US).
DURBHA, Ananth; (US).
KADIYALA, Suresh; (US).
PADMANABHAN, Satish; (US)
Agent: DATTA, Madhumita; PILLSBURY WINTHROP SHAW PITTMAN LLP P.O. Box 10500 Intellectual Property Group McLean, VA 22102 (US)
Priority Data:
12/906,857 18.10.2010 US
Title (EN) INTELLIGENT ARCHITECTURE CREATOR
(FR) CRÉATEUR D'ARCHITECTURE INTELLIGENTE
Abstract: front page image
(EN)Systems and methods are disclosed to automatically generate a processor architecture for a custom integrated circuit (IC) described by a computer readable code. The IC has one or more timing and hardware constraints. The system extracts parameters defining the processor architecture from a static profile and a dynamic profile of the computer readable code; iteratively optimizes the processor architecture by changing one or more parameters until, all timing and hardware constraints expressed as a cost function are met; and synthesizes the generated processor architecture into a computer readable description of the custom integrated circuit for semiconductor fabrication.
(FR)La présente invention se rapporte à des systèmes et à des procédés adaptés pour générer automatiquement une architecture de processeur pour un circuit intégré (IC, Integrated Circuit) personnalisé décrit par un code lisible par un ordinateur. Le circuit intégré comporte une contrainte temporelle et une contrainte matérielle ou plus. Le système extrait des paramètres qui définissent l'architecture de processeur du point de vue d'un profil statique et du point de vue d'un profil dynamique du code lisible par un ordinateur. Le système optimise d'autre part l'architecture de processeur de façon itérative en changeant un paramètre ou plus jusqu'à ce que toutes les contraintes temporelles et matérielles exprimées en fonction du coût soient respectées. Enfin, le système synthétise l'architecture de processeur générée en une description lisible par un ordinateur du circuit intégré personnalisé en vue de la fabrication de semi-conducteurs.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)