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Pub. No.:    WO/2012/053462    International Application No.:    PCT/JP2011/073781
Publication Date: 26.04.2012 International Filing Date: 17.10.2011
G09G 3/30 (2006.01), G09G 3/20 (2006.01)
Applicants: SHARP KABUSHIKI KAISHA [JP/JP]; 22-22, Nagaike-cho, Abeno-ku, Osaka-shi, Osaka 5458522 (JP) (For All Designated States Except US).
KISHI, Noritaka; (For US Only)
Inventors: KISHI, Noritaka;
Agent: SHIMADA, Akihiro; Shimada Patent Firm Manseian Building 1-10-3, Yagi-cho Kashihara-shi, Nara 6340078 (JP)
Priority Data:
2010-236209 21.10.2010 JP
(JA) 表示装置およびその駆動方法
Abstract: front page image
(EN)Provided is a display device having a simple configuration, and capable of ensuring a sufficient period for threshold detection and suppressing uneven brightness. The display device is provided with: a plurality of pixel circuits; a gate driver circuit connected to a plurality of scanning signal lines and a plurality of control lines; and a power source control circuit connected to a plurality of power lines via a common power line. The pixel circuits include an organic EL element, a plurality of TFTs, and a capacitor. After initialization and threshold detection is performed on a plurality of rows together in each frame period, writing and light emission are performed individually on each row in succession. Writing is performed in ascending order from row 1 to row n in the early frame (first frame) of two connected frame periods, while writing is performed in descending order from row n to row 1 in the later frame (second frame) of the two frame periods.
(FR)Cette invention concerne un dispositif d'affichage de configuration simple, laissant garantir une période suffisante pour la détection de seuil et la suppression d'une luminosité irrégulière. Le dispositif d'affichage comprend : une pluralité de circuits de pixels, un circuit de commande de grille connecté à une pluralité de lignes de signaux de balayage et une pluralité de lignes de commande ; et un circuit de commande de source d'alimentation électrique connecté à une pluralité de lignes de puissance via une ligne de puissance commune. Les circuits de pixels comprennent un élément électroluminescent organique, une pluralité de TFT (transistors en couches minces), et un condensateur. Après initialisation et détection de seuils sur une pluralité de rangées dans chaque période de trame, les opérations d'écriture et d'émission de lumière sont exécutées individuellement sur chaque rangée successivement. L'écriture se déroule en ordre ascendant de la rangée 1 jusqu'à la rangée n dans la trame initiale (première trame) de deux périodes de trame connectées, alors que l'écriture se déroule l'ordre descendant de la rangée n à la rangée 1 dans la trame suivante (seconde trame) des deux périodes de trame.
(JA) 簡易な構成で閾値検出のための期間を充分に確保することができ、かつ、輝度ムラの発生を抑止することのできる表示装置を提供する。 表示装置は、複数の画素回路と、複数の走査信号線および複数の制御線に接続されたゲートドライバ回路と、複数の電源線に共通電源線を介して接続された電源制御回路とを備える。画素回路は、有機EL素子と複数のTFTとコンデンサとを含む。各フレーム期間において、初期化および閾値検出が複数の行で一括して行われた後、1行ずつ順次に書き込みおよび発光が行われる。ここで、連続する2フレーム期間のうちの先行するフレーム(1フレーム目)においては、1行目からn行目の順(昇順)に書き込みが行われ、当該2フレーム期間のうちの後続のフレーム(2フレーム目)においては、n行目から1行目の順(降順)に書き込みが行われる。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)