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1. (WO2012049572) RELIABLE SIGNALING OF FAULT CONDITIONS IN BATTERY SYSTEMS WITH SERIES-CONNECTED CELLS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2012/049572    International Application No.:    PCT/IB2011/050654
Publication Date: 19.04.2012 International Filing Date: 17.02.2011
IPC:
G01R 31/36 (2006.01), H01M 10/48 (2006.01), G01R 31/3183 (2006.01)
Applicants: SENDYNE CORP. [US/US]; 250 West Broadway - 6th floor New York, New York 10013 (US) (For All Designated States Except US).
MARTEN, Victor [US/US]; (US) (For US Only)
Inventors: MARTEN, Victor; (US)
Agent: OPPEDAHL, Carl; Oppedahl Patent Law Firm LLC P O Box 5940 Dillon, CO 80435-5940 (US)
Priority Data:
61/393,249 14.10.2010 US
Title (EN) RELIABLE SIGNALING OF FAULT CONDITIONS IN BATTERY SYSTEMS WITH SERIES-CONNECTED CELLS
(FR) SIGNALISATION FIABLE DE SITUATIONS DE DÉFAUT DANS DES SYSTÈMES ACCUMULATEURS COMPORTANT DES ÉLÉMENTS MONTÉS EN SÉRIE
Abstract: front page image
(EN)A system is used with a plurality of modules, each module requiring galvanic isolation from the other modules. Galvanic isolators are employed, each having an input and an output, the output galvanically isolated from the input, the output responsive to the input according to a response characteristic of the isolator. Each module has, a respective first isolator and a respective second isolator. The input of each respective first isolator and each respective second isolator for each module is disposed controllably to receive an activation signal from the module indicative of a module fault to be annunciated or to receive a test signal from the module, the test signal being smaller than the activation signal. The outputs of the respective first isolators are aggregated to a first node and the outputs of the respective second isolators are aggregated to a second node. A selection circuit selects from the first node and the second node, yielding a fault signal output when the selected node satisfies a predetermined condition. An analog-to-digital converter is coupled with each of the nodes, the analog-to-digital converter disposed to sense an output from one of the isolators indicative of its response characteristic in the event of a test signal being applied to the isolator.
(FR)L'invention concerne un système comportant une pluralité de modules, chaque module exigeant une isolation galvanique par rapport aux autres modules. Des isolateurs galvaniques sont utilisés, chacun ayant une entrée et une sortie, la sortie étant isolée galvaniquement de l'entrée et la sortie répondant à l'entrée en fonction d'une caractéristique de réponse de l'isolateur. Chaque module possède un premier isolateur respectif et un second isolateur respectif. L'entrée de chaque premier isolateur respectif et de chaque second isolateur respectif de chaque module est conçue pour pouvoir être commandée pour recevoir un signal d'activation provenant du module, indiquant un défaut du module à annoncer, ou pour recevoir un signal d'essai provenant du module, le signal d'essai étant inférieur au signal d'activation. Les sorties des premiers isolateurs respectifs sont agrégées vers un premier nœud et les sorties des seconds isolateurs respectifs sont agrégées vers un second nœud. Un circuit de sélection sélectionne le premier ou le second nœud et fournit une sortie de signal de défaut lorsque le nœud sélectionné satisfait une condition prédéterminée. Un convertisseur analogique-numérique est couplé à chacun des nœuds et est conçu pour détecter une sortie de l'un des isolateurs, qui indique sa caractéristique de réponse dans le cas où un signal d'essai est appliqué à l'isolateur.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
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African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)