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1. (WO2011141965) DISPLAY DEVICE AND METHOD FOR MANUFACTURING SAME
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2011/141965    International Application No.:    PCT/JP2010/003235
Publication Date: 17.11.2011 International Filing Date: 13.05.2010
Chapter 2 Demand Filed:    29.09.2010    
IPC:
G09F 9/30 (2006.01), G09F 9/00 (2006.01), H01L 27/32 (2006.01)
Applicants: PANASONIC CORPORATION [JP/JP]; 1006, Oaza Kadoma, Kadoma-shi, Osaka 5718501 (JP) (For All Designated States Except US).
SHIROUZU, Hiroshi; (For US Only).
TAJIKA, Kenichi; (For US Only)
Inventors: SHIROUZU, Hiroshi; .
TAJIKA, Kenichi;
Agent: NII, Hiromori; c/o NII Patent Firm, 6F, Tanaka Ito Pia Shin-Osaka Bldg.,3-10, Nishi Nakajima 5-chome, Yodogawa-ku, Osaka-city, Osaka 5320011 (JP)
Priority Data:
Title (EN) DISPLAY DEVICE AND METHOD FOR MANUFACTURING SAME
(FR) DISPOSITIF D'AFFICHAGE ET SON PROCÉDÉ DE FABRICATION
(JA) 表示装置及びその製造方法
Abstract: front page image
(EN)Disclosed is a display device wherein a failure light emitting pixel is emitted in normal light emitting timing, even if a pixel circuit is highly integrated. Also disclosed is a method for manufacturing the display device. In the display device wherein a display element layer and a drive circuit layer are laminated, the drive circuit layer is provided with a retention capacity element (23A) having an upper electrode layer (231) and a lower electrode layer (232), which face each other in the laminating direction. The upper electrode layer (231) is provided with: an upper capacity electrode section (231b), which connects together two circuit elements; and an upper capacity electrode section (231a), which is connected to the electrode section (231b) by having therebetween a section (231s) that can be cut. The lower electrode layer (232) is provided with: a lower capacity electrode section (232a), which connects together two circuit elements; and a lower capacity electrode section (232b), which is connected to the electrode section (232a) by having therebetween a section (232s) that can be cut. The retention capacity element (23A) retains capacitance between the upper capacity electrode section (231b) and the lower capacity electrode section (232b), and between the lower capacity electrode section (232a) and the upper capacity electrode section (231a).
(FR)L'invention porte sur un dispositif d'affichage dans lequel un pixel d'émission de lumière de défaillance est émis dans un temps d'émission de lumière normal, même si un circuit de pixel est hautement intégré. L'invention porte également sur un procédé de fabrication du dispositif d'affichage. Dans le dispositif d'affichage dans lequel une couche d'élément d'affichage et une couche de circuit de commande sont stratifiées, la couche de circuit de commande comporte un élément de capacité de retenue (23A) ayant une couche d'électrode supérieure (231) et une couche d'électrode inférieure (232), qui sont tournées l'une vers l'autre dans la direction de stratification. La couche d'électrode supérieure (231) comporte : une section d'électrode de capacité supérieure (231b) qui connecte ensemble deux éléments de circuit ; et une section d'électrode de capacité supérieure (231a) qui est connectée à la section d'électrode (231b) en ayant entre elles une section (231s) qui peut être coupée. La couche d'électrode inférieure (232) comporte : une section d'électrode de capacité inférieure (232a) qui connecte ensemble deux éléments de circuit ; et une section d'électrode de capacité inférieure (232b) qui est connectée à la section d'électrode (232a) en ayant entre elles une section (232s) qui peut être coupée. L'élément de capacité de retenue (23A) retient la capacitance entre la section d'électrode de capacité supérieure (231b) et la section d'électrode de capacité inférieure (232b), et entre la section d'électrode de capacité inférieure (232a) et la section d'électrode de capacité supérieure (231a).
(JA) 画素回路が高密度化されても、不良発光画素を正常発光タイミングで発光させるための表示装置及びその製造方法を提供する。表示素子層と駆動回路層とが積層された表示装置であって、駆動回路層は積層方向において対向する上側電極層(231)及び下側電極層(232)を有する保持容量素子(23A)を備え、上側電極層(231)は、2つの回路素子を接続する上側容量電極部(231b)と、当該電極部と切断可能部(231s)を介して接続された上側容量電極部(231a)とを備え、下側電極層(232)は、2つの回路素子を接続する下側容量電極部(232a)と、当該電極部と切断可能部(232s)を介して接続された下側容量電極部(232b)とを備え、保持容量素子(23A)は、上側容量電極部(231b)と下側容量電極部(232b)との間、及び下側容量電極部(232a)と上側容量電極部(231a)との間でそれぞれ静電容量を保持する。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)