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1. (WO2010141909) DIGITAL PHASE LOCKED LOOP WITH PARTS OPERATING AT DIFFERENT SAMPLE RATES
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2010/141909    International Application No.:    PCT/US2010/037530
Publication Date: 09.12.2010 International Filing Date: 04.06.2010
IPC:
H03L 7/08 (2006.01), H03C 3/09 (2006.01)
Applicants: QUALCOMM Incorporated [US/US]; Attn: International Ip Administration 5775 Morehouse Drive San Diego, California 92121 (US) (For All Designated States Except US).
BALLANTYNE, Gary, John [NZ/NZ]; (US) (For US Only).
GENG, Jifeng [CN/US]; (US) (For US Only).
FILIPOVIC, Daniel, F. [US/US]; (US) (For US Only)
Inventors: BALLANTYNE, Gary, John; (US).
GENG, Jifeng; (US).
FILIPOVIC, Daniel, F.; (US)
Agent: XU, Jiayu; Attn: International IP Administration 5775 Morehouse Drive San Diego, Califonia 92121 (US)
Priority Data:
12/478,506 04.06.2009 US
Title (EN) DIGITAL PHASE LOCKED LOOP WITH PARTS OPERATING AT DIFFERENT SAMPLE RATES
(FR) BOUCLE NUMÉRIQUE À VERROUILLAGE DE PHASE DOTÉE DE PARTIES FONCTIONNANT SELON DIFFÉRENTES FRÉQUENCES D'ÉCHANTILLONNAGE
Abstract: front page image
(EN)A Digital Phase-Locked Loop (DPLL) involves a Time-to-Digital Converter (TDC) that receives a DCO output signal and a reference clock and outputs a first stream of digital values. Quantization noise is reduced by clocking the TDC at a high rate. Downsampling circuitry converts the first stream into a second stream. The second stream is supplied to a phase detecting summer of the DPLL such that a control portion of the DPLL can switch at a lower rate to reduce power consumption. The DPLL is therefore referred to as a multi-rate DPLL. A third stream of digital tuning words output by the control portion is upsampled before being supplied to the DCO so that the DCO can be clocked at the higher rate, thereby reducing digital images. In a receiver application, no upsampling is performed and the DCO is clocked at the lower rate, thereby further reducing power consumption.
(FR)L'invention concerne une boucle numérique à verrouillage de phase (DPLL) impliquant un convertisseur temps-numérique (TDC) qui reçoit un signal de sortie DCO et une horloge de référence, et délivre un premier flux de valeurs numériques. Un bruit de quantification est réduit par synchronisation du TDC à une fréquence élevée. Des circuits de sous-échantillonnage convertissent le premier flux en un second flux qui alimente un sommateur de détection de phase de la DPLL de telle sorte qu'une partie commande de la DPLL peut passer à une fréquence inférieure pour réduire la consommation de puissance. La DPLL est donc qualifiée de DPLL à fréquences multiples. Un troisième flux de mots de syntonisation numérique délivré par la partie commande est suréchantillonné avant d'être fourni au DCO de telle sorte que le DCO peut être synchronisé à une fréquence plus élevée, ce qui permet de réduire les images numériques. Dans une application de récepteur, aucun suréchantillonnage n'est effectué et le DCO est synchronisé à une fréquence plus faible, ce qui permet également de réduire la consommation de puissance.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)