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1. (WO2010139941) A DATA PROCESSING APPARATUS AND METHOD FOR HANDLING VECTOR INSTRUCTIONS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2010/139941    International Application No.:    PCT/GB2010/001067
Publication Date: 09.12.2010 International Filing Date: 28.05.2010
Chapter 2 Demand Filed:    31.03.2011    
IPC:
G06F 9/38 (2006.01), G06F 9/32 (2006.01)
Applicants: ARM LIMITED [GB/GB]; 110 Fulbourn Road Cherry Hinton Cambridge CB1 9NJ (GB) (For All Designated States Except US).
BJÖRKLUND, Andreas [SE/SE]; (SE) (For US Only).
PERSSON, Erik [SE/SE]; (SE) (For US Only).
HUGOSSON, Ola [SE/SE]; (SE) (For US Only)
Inventors: BJÖRKLUND, Andreas; (SE).
PERSSON, Erik; (SE).
HUGOSSON, Ola; (SE)
Agent: HORNER, David, Richard; D Young & Co LLP 120 Holborn London EC1N 2DY (GB)
Priority Data:
0909756.9 05.06.2009 GB
Title (EN) A DATA PROCESSING APPARATUS AND METHOD FOR HANDLING VECTOR INSTRUCTIONS
(FR) APPAREIL ET PROCEDE DE TRAITEMENT DE DONNEES POUR LA GESTION D'INSTRUCTIONS VECTORIELLES
Abstract: front page image
(EN)A data processing apparatus and method and provided for handling vector instructions. The data processing apparatus has a register data store with a plurality of registers arranged to store data elements. A vector processing unit is then used to execute a sequence of vector instructions, with the vector processing unit having a plurality of lanes of parallel processing and having access to the register data store in order to read data elements from, and write data elements to, the register data store during the execution of the sequence of vector instructions. A skip indication storage maintains a skip indicator for each of the lanes of parallel processing. The vector processing unit is responsive to a vector skip instruction to perform an update operation to set within the skip indication storage the skip indicator for a determined one or more lanes. The vector processing unit is responsive to a vector operation instruction to perform an operation in parallel on data elements input to the plurality of lanes of parallel processing, but to exclude from the performance of the operation any lane whose associated skip indicator is set. This allows the operation specified by vector instructions to be performed conditionally within each of the lanes of parallel processing without any modification to the vector instructions that are specifying those operations.
(FR)La présente invention concerne un appareil et un procédé de traitement de données pour la gestion d'instructions vectorielles. L'appareil de traitement de données comporte une unité de stockage de données de registres avec une pluralité de registres agencés pour le stockage d'éléments de données. Une unité de traitement vectoriel est ensuite utilisée pour exécuter une séquence d'instructions vectorielles, l'unité de traitement vectoriel ayant une pluralité de couloirs de traitement parallèle et ayant un accès à l'unité de stockage de données de registres pour lire les éléments de données provenant de l'unité de stockage de données de registres et pour y écrire des éléments de données lors de l'exécution de la séquence d'instructions vectorielles. Une unité de stockage d'indications de saut contient un indicateur de saut pour chacun des couloirs de traitement parallèle. L'unité de traitement vectoriel réagit à l'instruction de saut vectorielle de saut pour effectuer une opération de mise à jour pour établir dans l'unité de stockage d'indications de saut l'indicateur de saut pour un ou des couloirs déterminé(s). L'unité de traitement vectoriel réagit à une instruction d'opération vectorielle pour effectuer une opération en parallèle sur les éléments de données entrées dans la pluralité de couloirs de traitement parallèle, mais pour exclure de la réalisation de l'opération tout couloir dont l'indicateur de saut associé est établi. Cela permet la réalisation conditionnelle de l'opération spécifiée par les instructions vectorielles dans chacun des couloirs de traitement parallèle sans aucune modification aux instructions vectorielles qui sont entrain de spécifier ces opérations.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)