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1. (WO2010137459) DIGITAL-ANALOG CONVERTER AND ANALOG-DIGITAL CONVERTER USING SAME
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2010/137459    International Application No.:    PCT/JP2010/058032
Publication Date: 02.12.2010 International Filing Date: 12.05.2010
IPC:
H03M 1/74 (2006.01), H01L 21/822 (2006.01), H01L 27/04 (2006.01), H03M 1/06 (2006.01), H03M 1/46 (2006.01)
Applicants: MITSUMI ELECTRIC CO., LTD. [JP/JP]; 2-11-2, Tsurumaki, Tama-Shi, Tokyo 2068567 (JP) (For All Designated States Except US).
INOUE, Fumihiro [JP/JP]; (JP) (For US Only)
Inventors: INOUE, Fumihiro; (JP)
Agent: ITOH, Tadahiko; 32nd Floor, Yebisu Garden Place Tower, 20-3, Ebisu 4-Chome, Shibuya-Ku, Tokyo 1506032 (JP)
Priority Data:
2009-125405 25.05.2009 JP
Title (EN) DIGITAL-ANALOG CONVERTER AND ANALOG-DIGITAL CONVERTER USING SAME
(FR) CONVERTISSEUR NUMÉRIQUE-ANALOGIQUE ET CONVERTISSEUR ANALOGIQUE-NUMÉRIQUE L'UTILISANT
(JA) デジタル-アナログ変換器及びこれを用いたアナログ-デジタル変換器
Abstract: front page image
(EN)A digital-analog converter comprises a capacitor array having a plurality of unit capacitors each including an input electrode (20) connected to an individual input metal wire (52) and receiving an input signal from the input metal wire (52) and an output electrode (30) disposed facing the input electrode (20) and outputting an output signal. The input metal wire (52) surrounds, in a top view, an output metal wire (53) connected to the output electrode (30) or has a guard wire portion (60) disposed so as to cover the output metal wire (53) from the upper side. The parasitic capacitance formed between the guard wire portion (60) and the output metal wire (53) is adjusted on a per unit capacitor basis, thereby correcting an integral non-linearity error included in the capacitor array.
(FR)L'invention porte sur un convertisseur numérique-analogique qui comprend un réseau de condensateurs comprenant une pluralité de condensateurs unitaires comprenant chacun une électrode d'entrée (20) connectée à un fil métallique d'entrée individuel (52) et recevant un signal d'entrée provenant du fil métallique d'entrée (52) et une électrode de sortie (30) agencée face à l'électrode d'entrée (20) et délivrant un signal de sortie. Le fil métallique d'entrée (52) entoure, en vue de dessus, un fil métallique de sortie (53) connecté à l'électrode de sortie (30) ou comprend une partie fil de garde (60) agencée de façon à couvrir le fil métallique de sortie (53) par le côté supérieur. La capacité parasite formée entre la partie fil de garde (60) et le fil métallique de sortie (53) est ajustée sur une base par condensateur unitaire, pour ainsi corriger une erreur de non-linéarité intégrée incluse dans le réseau de condensateurs.
(JA)デジタル-アナログ変換器は、個別に入力用金属配線(52)が接続され、該入力用金属配線(52)から入力信号が入力される入力電極(20)と、該入力電極(20)と対向して配置され、出力信号が出力される出力電極(30)とを含む単位容量を複数有するキャパシタアレイを備え、前記入力用金属配線(52)は、前記出力電極(30)に接続された出力用金属配線(53)を上面視的に囲むか、又は上方から覆うように配置されたガード配線部(60)を有し、該ガード配線部(60)と、前記出力金属配線(53)との間で形成される寄生静電容量を各単位容量で調整し、前記キャパシタアレイが有する積分非直線性誤差を補正する。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)