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1. (WO2010125336) METHOD AND APPARATUS FOR SCHEDULING THE ISSUE OF INSTRUCTIONS IN A MULTITHREADED MICROPROCESSOR
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Pub. No.: WO/2010/125336 International Application No.: PCT/GB2010/000832
Publication Date: 04.11.2010 International Filing Date: 27.04.2010
IPC:
G06F 9/38 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
9
Arrangements for programme control, e.g. control unit
06
using stored programme, i.e. using internal store of processing equipment to receive and retain programme
30
Arrangements for executing machine- instructions, e.g. instruction decode
38
Concurrent instruction execution, e.g. pipeline, look ahead
Applicants:
IMAGINATION TECHNOLOGIES LIMITED [GB/GB]; Home Park Estate Kings Langley Hertfordshire WD4 8LZ, GB (AllExceptUS)
WEBBER, Andrew, David [GB/GB]; GB (UsOnly)
Inventors:
WEBBER, Andrew, David; GB
Agent:
REDDIE & GROSE; 16 Theobalds Road London WC1X 8PL, GB
Priority Data:
0907286.928.04.2009GB
Title (EN) METHOD AND APPARATUS FOR SCHEDULING THE ISSUE OF INSTRUCTIONS IN A MULTITHREADED MICROPROCESSOR
(FR) PROCÉDÉ ET APPAREIL PERMETTANT DE PLANIFIER L'ÉMISSION D'INSTRUCTIONS DANS UN MICROPROCESSEUR À PLUSIEURS UNITÉS D'EXÉCUTION
Abstract:
(EN) There is provided a method to dynamically determine which instructions from a plurality of available instructions to issue in each clock cycle in a multithreaded processor capable of issuing a plurality of instructions in each clock cycle, comprising the steps of: determining a highest priority instruction from the plurality of available instructions; determining the compatibility of the highest priority instruction with each of the remaining available instructions; and issuing the highest priority instruction together with other instructions compatible with the highest priority instruction in the same clock cycle; wherein the highest priority instruction cannot be a speculative instruction. The effect of this is that speculative instructions are only ever issued together with at least one non- speculative instruction.
(FR) L'invention concerne un procédé permettant de déterminer dynamiquement les instructions parmi une pluralité d'instructions disponibles qui doivent être émises dans chaque cycle d'horloge d'un processeur à plusieurs unités d'exécution pouvant émettre une pluralité d'instructions dans chaque cycle d'horloge, qui consiste à : déterminer une instruction présentant la plus haute priorité parmi la pluralité d'instructions disponibles, déterminer la compatibilité de l'instruction présentant la plus haute priorité avec chacune des instructions disponibles restantes; et émettre l'instruction présentant la plus haute priorité en même temps que d'autres instructions compatibles avec l'instruction présentant la plus haute priorité dans le même cycle d'horloge; l'instruction présentant la plus haute priorité ne peut pas être une instruction spéculative. Cela a pour effet que des instructions spéculatives sont émises uniquement ensemble avec au moins une instruction non spéculative.
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Publication Language: English (EN)
Filing Language: English (EN)
Also published as:
US20100275211EP2425329JP2012525620CN102414659US20160055002