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1. (WO2010119932) MULTI-PROCESSOR SYSTEM, AND MEMORY MANAGEMENT METHOD AND COMMUNICATION PROGRAM IN MULTI-PROCESSOR SYSTEM
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Pub. No.: WO/2010/119932 International Application No.: PCT/JP2010/056797
Publication Date: 21.10.2010 International Filing Date: 09.04.2010
IPC:
G06F 15/167 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
15
Digital computers in general; Data processing equipment in general
16
Combinations of two or more digital computers each having at least an arithmetic unit, a programme unit and a register, e.g. for a simultaneous processing of several programmes
163
Interprocessor communication
167
using a common memory, e.g. mailbox
Applicants:
上久保 雅規 UEKUBO, Masaki [JP/JP]; JP (UsOnly)
日本電気株式会社 NEC Corporation [JP/JP]; 東京都港区芝五丁目7番1号 7-1, Shiba 5-chome, Minato-ku, Tokyo 1088001, JP (AllExceptUS)
Inventors:
上久保 雅規 UEKUBO, Masaki; JP
Agent:
池田 憲保 IKEDA, Noriyasu; 東京都千代田区内幸町1丁目2番2号日比谷ダイビル Hibiya Daibiru Bldg., 2-2, Uchisaiwaicho 1-chome, Chiyoda-ku, Tokyo 1000011, JP
Priority Data:
2009-10045617.04.2009JP
Title (EN) MULTI-PROCESSOR SYSTEM, AND MEMORY MANAGEMENT METHOD AND COMMUNICATION PROGRAM IN MULTI-PROCESSOR SYSTEM
(FR) SYSTÈME MULTIPROCESSEUR ET PROCÉDÉ DE GESTION DE MÉMOIRE ET PROGRAMME DE COMMUNICATION DANS UN SYSTÈME MULTIPROCESSEUR
(JA) マルチプロセッサシステム、マルチプロセッサシステムにおけるメモリ管理方法及び通信プログラム
Abstract:
(EN) A multi-processor system (100) has a plurality of processors (101 to 10m), a shared memory (120) connected to the processors (101 to 10m), and a timer (130) connected to the processors (101 to 10m). The shared memory (120) has a balance counter unit and a buffer region unit for storing communication data exchanged between the processors (101 to 10m). The buffer region unit includes a plurality of buffer regions each corresponding to either one of the processors (101 to 10m). The processors (101 to 10m) transfer the buffer regions at each timing point notified by the timer (130). The balance counter unit manages the increase and decrease of the transferred buffer regions.
(FR) La présente invention concerne un système multiprocesseur (100) comprenant une pluralité de processeurs (101 à 10m), une mémoire partagée (120) connectée aux processeurs (101 à 10m) et un minuteur connecté aux processeurs (101 à 10m). La mémoire partagée (120) a une unité de totaliseur-soustracteur et une unité de région de tampon pour stocker des données de communication échangée entre les processeurs (101 à 10m). L'unité de la région de tampon comprend une pluralité de régions de tampon, chacune correspondant à l'un quelconque des processeurs (101 à 10m). Les processeurs (101 à 10m) transfèrent les régions de tampon à chaque point de minutage indiqué par le minuteur (130). L'unité de totaliseur-soustracteur gère l'augmentation et la réduction des régions de tampon transférées.
(JA)  複数のプロセッサ101~10mと、プロセッサ101~10mに接続された共有メモリ120と、プロセッサ101~10mに接続されたタイマ130とを有するマルチプロセッサシステム100である。共有メモリ120は、プロセッサ101~10mの間での通信データを格納するバッファ用領域部と収支カウンタ部を有する。バッファ用領域部は、それぞれがいずれか1つのプロセッサ101~10mに対応する複数のバッファ用領域を含んでいる。プロセッサ101~10mは、タイマ130によって通知されるタイミングごとにバッファ用領域を受け渡しする。収支カウンタ部は、受け渡したバッファ用領域の増減を管理する。
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Publication Language: Japanese (JA)
Filing Language: Japanese (JA)