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1. (WO2010117524) FLEXIBLY INTEGRATING ENDPOINT LOGIC INTO VARIED PLATFORMS
Latest bibliographic data on file with the International Bureau   

Pub. No.: WO/2010/117524 International Application No.: PCT/US2010/026284
Publication Date: 14.10.2010 International Filing Date: 05.03.2010
IPC:
H04L 12/28 (2006.01) ,H04L 12/56 (2006.01) ,G06F 15/16 (2006.01)
Applicants: KLINGLESMITH, Michael[US/US]; US (UsOnly)
NAIR, Mohan[US/US]; US (UsOnly)
MURRAY, Joseph[US/US]; US (UsOnly)
INTEL CORPORATION[US/US]; 2200 Mission College Boulevard MS: RNB-4-150 Santa Clara, California 95052, US (AllExceptUS)
Inventors: KLINGLESMITH, Michael; US
NAIR, Mohan; US
MURRAY, Joseph; US
Agent: TROP, Timothy N.; Trop, Pruner & Hu, P.C. 1616 S. Voss Rd., Ste. 750 Houston, Texas 77057-2631, US
Priority Data:
12/415,47031.03.2009US
Title (EN) FLEXIBLY INTEGRATING ENDPOINT LOGIC INTO VARIED PLATFORMS
(FR) FLEXIBILITÉ D'INTÉGRATION DE LA LOGIQUE D'UN POINT D'EXTRÉMITÉ DANS DES PLATEFORMES VARIÉES
Abstract: front page image
(EN) In one embodiment, the present invention is directed to an integrated endpoint having a virtual port coupled between an upstream fabric and an integrated device fabric that includes a multi-function logic to handle various functions for one or more intellectual property (IP) blocks coupled to the integrated device fabric. The integrated device fabric has a primary channel to communicate data and command information between the IP block and the upstream fabric and a sideband channel to communicate sideband information between the IP block and the multi-function logic. Other embodiments are described and claimed.
(FR) Dans un mode de réalisation, la présente invention concerne un point extrémité intégré possédant un port virtuel associé entre une matrice montante et une matrice d'un dispositif intégré qui comprend une logique multifonction pour gérer différentes fonctions d'un ou de plusieurs blocs de propriété intellectuelle (IP) associés à la matrice du dispositif intégré. La matrice du dispositif intégré possède un canal primaire pour communiquer des données et commander des informations entre le bloc IP et la matrice montante et un canal de bandes latérales pour communiquer des informations de bandes latérales entre le bloc IP et la logique multifonction. D'autres modes de réalisation sont décrits et revendiqués.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
African Regional Intellectual Property Organization (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Office (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (EPO) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG)
Publication Language: English (EN)
Filing Language: English (EN)