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1. (WO2010117404) MEMORY CONTROLLERS, MEMORY SYSTEMS, SOLID STATE DRIVERS AND METHODS FOR PROCESSING A NUMBER OF COMMANDS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2010/117404    International Application No.:    PCT/US2010/000732
Publication Date: 14.10.2010 International Filing Date: 11.03.2010
IPC:
G06F 13/16 (2006.01), G06F 3/06 (2006.01), G06F 12/00 (2006.01)
Applicants: MICRON TECHNOLOGY, INC. [US/US]; 8000 S Federal Way Boise, ID 83716-9632 (US) (For All Designated States Except US).
ASNAASHARI, Mehdi [US/US]; (US) (For US Only).
LIAO, Yu-song [US/US]; (US) (For US Only).
YANG, Jui-Yao [US/US]; (US) (For US Only).
NEMAZIE, Siamack [US/US]; (US) (For US Only)
Inventors: ASNAASHARI, Mehdi; (US).
LIAO, Yu-song; (US).
YANG, Jui-Yao; (US).
NEMAZIE, Siamack; (US)
Agent: KERN, Jacob, T.; Brooks, Cameron & Huebsch, PLLC 1221 Nicollet Avenue, Suite 500 Minneapolis, MN 55403 (US)
Priority Data:
12/421,093 09.04.2009 US
Title (EN) MEMORY CONTROLLERS, MEMORY SYSTEMS, SOLID STATE DRIVERS AND METHODS FOR PROCESSING A NUMBER OF COMMANDS
(FR) CONTRÔLEURS DE MÉMOIRE, SYSTÈMES DE MÉMOIRE, COMMANDES À L'ÉTAT SOLIDE ET PROCÉDÉS SERVANT À TRAITER UN CERTAIN NOMBRE DE COMMANDES
Abstract: front page image
(EN)The present disclosure includes methods and devices for a memory controller. In one or more embodiments, a memory controller includes a plurality of back end channels, and a command queue communicatively coupled to the plurality of back end channels. The command queue is configured to hold host commands received from a host. Circuitry is configured to generate a number of back end commands at least in response to a number of the host commands in the command queue, and distribute the number of back end commands to a number of the plurality of back end channels.
(FR)La présente invention concerne des procédés et des dispositifs destinés à un contrôleur de mémoire. Dans un ou plusieurs modes de réalisation, un contrôleur de mémoire comprend une pluralité de canaux dorsaux, et une file d'attente de commande associée de façon communicative à la pluralité de canaux dorsaux. La file d'attente de commande est configurée pour conserver des commandes d'hôte reçues d'un hôte. L'ensemble de circuits est configuré pour générer un certain nombre de commandes dorsales au moins en réponse à un nombre de commandes d'hôte dans la file d'attente de commandes, et pour distribuer le nombre de commandes dorsales à un certain nombre de la pluralité de canaux dorsaux.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)