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1. (WO2010077751) COPROCESSOR UNIT WITH SHARED INSTRUCTION STREAM
Latest bibliographic data on file with the International Bureau

Pub. No.: WO/2010/077751 International Application No.: PCT/US2009/067409
Publication Date: 08.07.2010 International Filing Date: 10.12.2009
IPC:
G06F 9/38 (2006.01) ,G06F 12/10 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
9
Arrangements for programme control, e.g. control unit
06
using stored programme, i.e. using internal store of processing equipment to receive and retain programme
30
Arrangements for executing machine- instructions, e.g. instruction decode
38
Concurrent instruction execution, e.g. pipeline, look ahead
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
12
Accessing, addressing or allocating within memory systems or architectures
02
Addressing or allocation; Relocation
08
in hierarchically structured memory systems, e.g. virtual memory systems
10
Address translation
Applicants:
ADVANCED MICRO DEVICES, INC. [US/US]; One AMD Place P.O. Box 3453 Sunnyvale, California 94088, US (AllExceptUS)
FRANK, Michael [DE/US]; US (UsOnly)
Inventors:
FRANK, Michael; US
Agent:
MUNYON, Dean, M.; Meyertons, Hood, Kivlin, Kowert & Goetzel, P.C. P.O. Box 398 Austin, Texas 78767-0398, US
Priority Data:
12/337,15917.12.2008US
Title (EN) COPROCESSOR UNIT WITH SHARED INSTRUCTION STREAM
(FR) UNITÉ DE COPROCESSEUR COMPORTANT UN FLUX PARTAGÉ D'INSTRUCTIONS
Abstract:
(EN) A processor unit and a coprocessor unit are disclosed. In one embodiment, the processor unit includes a functional unit that receives a set of instructions in an instruction stream and provides the set of instructions to the coprocessor unit. The coprocessor executes the instructions and initiates transmission of a set of execution results corresponding to the set of instructions to the processor unit's functional unit. The processor functional unit may be coupled to the coprocessor unit through a shared bus circuit implementing a packet-based protocol. The processor unit and the coprocessor unit may share a coherent view of system memory. In various embodiments, the functional unit may alter entries in a translation lookaside buffer (TLB) located in the coprocessor unit, resume and suspend a thread executing on the coprocessor unit, etc.
(FR) L'invention concerne une unité de processeur et une unité de coprocesseur. Dans une forme de réalisation, l'unité de processeur comprend une unité fonctionnelle qui reçoit un ensemble d'instructions dans un flux d'instructions et transmet cet ensemble d'instructions à l'unité de coprocesseur. Le coprocesseur exécute les instructions et commence à transmettre à l'unité fonctionnelle du processeur un ensemble de résultats d'exécution correspondant à l'ensemble d'instructions. L'unité fonctionnelle du processeur peut être couplée à l'unité de coprocesseur par un circuit de bus partagé mettant en œuvre un protocole basé sur des paquets. L'unité de processeur et l'unité de coprocesseur peuvent partager une vision cohérente de système de mémoire. Dans diverses formes de réalisation, l'unité fonctionnelle peut modifier des entrées dans une mémoire tampon de traduction en parallèle (TLB) se situant dans l'unité de coprocesseur, reprendre et suspendre un fil d'exécution exécuté sur l'unité de coprocesseur, etc.
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Publication Language: English (EN)
Filing Language: English (EN)
Also published as:
EP2374060JP2012512490CN102282540KR1020110106368IN5215/DELNP/2011