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1. (WO2010029009) VIRTUALIZATION IN A MULTI-CORE PROCESSOR (MCP)
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2010/029009    International Application No.:    PCT/EP2009/061396
Publication Date: 18.03.2010 International Filing Date: 03.09.2009
IPC:
G06F 12/08 (2006.01), G06F 13/364 (2006.01), G06F 15/163 (2006.01)
Applicants: INTERNATIONAL BUSINESS MACHINES CORPORATION [US/US]; New Orchard Road Armonk, New York 10504 (US) (For All Designated States Except US).
DUVALSAINT, Karl [US/US]; (US) (For US Only).
KIM, Daeik [KR/US]; (US) (For US Only).
HOFSTEE, Harm, Peter [NL/US]; (US) (For US Only).
KIM, Moon, Ju [US/US]; (US) (For US Only)
Inventors: DUVALSAINT, Karl; (US).
KIM, Daeik; (US).
HOFSTEE, Harm, Peter; (US).
KIM, Moon, Ju; (US)
Agent: LING, Christopher, John; (GB)
Priority Data:
12/208,651 11.09.2008 US
Title (EN) VIRTUALIZATION IN A MULTI-CORE PROCESSOR (MCP)
(FR) VIRTUALISATION DANS UN PROCESSEUR MULTI-CŒUR (MCP)
Abstract: front page image
(EN)This invention describes an apparatus, computer architecture, method, operating system, compiler, and application program products for MPEs as well as virtualization in a symmetric MCP. The disclosure is applied to a generic microprocessor architecture with a set (e.g., one or more) of controlling elements (e.g., MPEs) and a set of groups of sub- processing elements (e.g., SPEs). Under this arrangement, MPEs and SPEs are organized in a way that a smaller number MPEs control the behavior of a group of SPEs. The apparatus enables virtualized control threads within MPEs to be assigned to different groups of SPEs for controlling the same. The apparatus further includes a MCP coupled to a power supply coupled with cores to provide a supply voltage to each core (or core group) and controlling- digital elements and multiple instances of sub-processing elements.
(FR)Cette invention porte sur un appareil, une architecture d'ordinateur, un procédé, un système d'exploitation, un compilateur et des produits programmes d'application pour des MPE ainsi qu'une virtualisation dans un processeur multi-cœur (MCP) symétrique. L'invention s'applique à une architecture de microprocesseur générique comportant un ensemble (par exemple, un ou plusieurs) d'éléments de commande (par exemple, des MPE) et un ensemble de groupes d'éléments de traitement secondaire (par exemple, des SPE). Selon cet agencement, des MPE et des SPE sont organisés d'une manière telle qu'un plus petit nombre de MPE commandent le comportement d'un groupe de SPE. L'appareil permet d'attribuer des fils de commande virtualisés dans des MPE à différents groupes de SPE pour commander ceux-ci. L'appareil comprend en outre un MCP couplé à une alimentation électrique couplée à des cœurs pour fournir une tension d'alimentation à chaque cœur (ou groupe de cœurs) et des éléments numériques de commande et de multiples instances d'éléments de traitement secondaire.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)