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1. (WO2010024059) ACTIVE MATRIX SUBSTRATE, LIQUID CRYSTAL PANEL, LIQUID CRYSTAL DISPLAY UNIT, LIQUID CRYSTAL DISPLAY, TELEVISION RECEIVER, AND METHOD OF MANUFACTURING ACTIVE MATRIX SUBSTRATE
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2010/024059    International Application No.:    PCT/JP2009/062826
Publication Date: 04.03.2010 International Filing Date: 15.07.2009
IPC:
G02F 1/1368 (2006.01)
Applicants: SHARP KABUSHIKI KAISHA [JP/JP]; 22-22, Nagaike-cho, Abeno-ku, Osaka-shi, Osaka 5458522 (JP) (For All Designated States Except US).
TSUBATA, Toshihide; (For US Only)
Inventors: TSUBATA, Toshihide;
Agent: HARAKENZO WORLD PATENT & TRADEMARK; Daiwa Minamimorimachi Building, 2-6, Tenjinbashi 2-chome Kita, Kita-ku, Osaka-shi, Osaka 5300041 (JP)
Priority Data:
2008-218832 27.08.2008 JP
Title (EN) ACTIVE MATRIX SUBSTRATE, LIQUID CRYSTAL PANEL, LIQUID CRYSTAL DISPLAY UNIT, LIQUID CRYSTAL DISPLAY, TELEVISION RECEIVER, AND METHOD OF MANUFACTURING ACTIVE MATRIX SUBSTRATE
(FR) SUBSTRAT À MATRICE ACTIVE, PANNEAU À CRISTAUX LIQUIDES, UNITÉ D'AFFICHAGE À CRISTAUX LIQUIDES, DISPOSITIF D'AFFICHAGE À CRISTAUX LIQUIDES, POSTE DE TÉLÉVISION ET PROCÉDÉ DE FABRICATION DU SUBSTRAT À MATRICE ACTIVE
(JA) アクティブマトリクス基板、液晶パネル、液晶表示ユニット、液晶表示装置、テレビジョン受像機、アクティブマトリクス基板の製造方法
Abstract: front page image
(EN)In each pixel region of an active matrix substrate, first and second pixel electrodes (17a, 17b) and first to third capacitance electrodes (67x to 67z) formed in the same layer as that of a data signal line (15) are provided, one conductive electrode (9) of the conductive electrodes of a transistor, the first pixel electrode (17a), and the second capacitance electrode (67y) are electrically connected, and the first and third capacitance electrodes (67x, 67z) and the second pixel electrode (17b) are electrically connected, the first to third capacitance electrodes are so arranged in a row direction in order of mention as to overlap a retention capacitance line (18) with a first insulating film interposed therebetween, and the second capacitance electrode (67y) overlaps the second pixel electrode (17b) with a second insulating film interposed therebetween.  With the above constitution, the yields of the capacitive-coupling pixel-division active matrix substrate and a liquid crystal panel comprising the same can be increased.
(FR)La présente invention porte sur des première et seconde électrodes de pixel (17a, 17b) et sur une première jusqu'à une troisième électrode capacitive (67x à 67z) formées sur la même couche que celle d'une ligne de signal de données (15) qui sont disposées dans chaque région de pixel. Une électrode conductrice (9) parmi des électrodes conductrices d'un transistor, la première électrode de pixel (17a) et la seconde électrode capacitive (67y) sont raccordées électriquement, et les première et troisième électrodes capacitives (67x, 67z) et la seconde électrode de pixel (17b) sont raccordées électriquement, les électrodes allant jusqu'à la troisième électrode capacitive sont disposées, dans l'ordre mentionné, dans une direction horizontale de sorte à recouvrir partiellement une ligne capacitive de rétention (18) avec un premier film isolant intercalé entre elles et la seconde électrode capacitive (67y) recouvre partiellement la seconde électrode de pixel (17b) avec un second film isolant intercalé entre elles. Avec la constitution ci-dessus, les rendements du substrat à matrice active de division de pixels à couplage capacitif et d'un panneau à cristaux liquides comprenant ce substrat peuvent être accrus.
(JA) 1つの画素領域に、第1および第2の画素電極(17a・17b)と、データ信号線(15)と同層に形成された第1~第3容量電極(67x~67z)とが設けられ、トランジスタの一方の導通電極(9)と第1画素電極(17a)と第2容量電極(67y)とが電気的に接続されるとともに、第1および第3容量電極(67x・67z)それぞれと第2画素電極(17y)とが電気的に接続され、該第1~第3容量電極は、第1絶縁膜を介して保持容量配線(18)と重なるように、この順に行方向に並べられ、第2容量電極(67y)は第2絶縁膜を介して第2画素電極(17b)と重なっている。上記構成によれば、容量結合型の画素分割方式のアクティブマトリクス基板およびこれを備えた液晶パネルにおいて、その歩留まりを向上させることができる。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)