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1. (WO2010023533) PROCESSOR SIMULATION USING INSTRUCTION TRACES OR MARKUPS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2010/023533    International Application No.:    PCT/IB2009/006631
Publication Date: 04.03.2010 International Filing Date: 24.08.2009
IPC:
G06F 17/50 (2006.01), G06F 11/34 (2006.01)
Applicants: TELEFONAKTIEBOLAGET L M ERICSSON (publ) [SE/SE]; S-164 83 STOCKHOLM (SE) (For All Designated States Except US).
WALKER, Anthony, Dean [US/US]; (US) (For US Only)
Inventors: WALKER, Anthony, Dean; (US)
Agent: CAMERON, Michael, G.; Ericsson Inc. 6300 Legacy, MS EVR 1-C-11 Plano, TX 75024 (US)
Priority Data:
12/198,595 26.08.2008 US
Title (EN) PROCESSOR SIMULATION USING INSTRUCTION TRACES OR MARKUPS
(FR) SIMULATION DE PROCESSEUR UTILISANT DES TRACES OU DES MARQUES D'INSTRUCTIONS
Abstract: front page image
(EN)An efficient, cycle-accurate processor execution simulator models a target processor by executing a program execution image comprising instructions having run-time dependencies resolved by execution on an existing processor compatible with the target processor. The instructions may have been executed upon a processor in an I/O environment too complex to model. In one embodiment, the simulator executes instructions that were directly executed on a processor. In another embodiment, a markup engine alters a compiled program image, with reference to instructions executed on a processor, to remove run-time dependencies. The marked up program image is then executed by the simulator. The processor execution simulator includes an update engine operative to cycle-accurately simulate instruction execution, and a communication engine operative to model each communication bus of the target processor.
(FR)L'invention porte sur un simulateur d'exécution de processeur efficace à cycle précis qui modélise un processeur cible par exécution d'une image d'exécution de programme comprenant des instructions dotées de dépendances à l'exécution résolues par exécution sur un processeur existant compatible avec le processeur cible. Les instructions peuvent avoir été exécutées sur un processeur dans un environnement d'entrée/sortie trop complexe pour être modélisé. Dans un mode de réalisation, le simulateur exécute des instructions qui ont été directement exécutées sur un processeur. Dans un autre mode de réalisation, un moteur de marquage modifie une image de programme compilée, en se rapportant à des instructions exécutées sur un processeur pour supprimer des dépendances à l'exécution. L'image de programme marquée est ensuite exécutée par le simulateur. Le simulateur d'exécution de processeur comprend un moteur de mise à jour efficace pour simuler une exécution d'instructions de façon cycliquement précise, et un moteur de communication efficace pour modéliser chaque bus de communication du processeur cible.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)