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1. (WO2010023501) MULTI-CORE CLOCKING SYSTEM WITH INTERLOCKED 'ANTI-FREEZE' MECHANISM
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2010/023501    International Application No.:    PCT/IB2008/053414
Publication Date: 04.03.2010 International Filing Date: 26.08.2008
IPC:
G06F 1/04 (2006.01), G06F 9/38 (2006.01)
Applicants: FREESCALE SEMICONDUCTOR, INC. [US/US]; 6501 William Cannon Drive West Austin, Texas 78735 (US) (For All Designated States Except US).
BEATTIE, Derek [GB/GB]; (GB) (For US Only).
CULSHAW, Carl [GB/GB]; (GB) (For US Only).
DEVINE, Alan [GB/GB]; (GB) (For US Only).
SCOBIE, James, Andrew, Collier [GB/GB]; (GB) (For US Only)
Inventors: BEATTIE, Derek; (GB).
CULSHAW, Carl; (GB).
DEVINE, Alan; (GB).
SCOBIE, James, Andrew, Collier; (GB)
Priority Data:
Title (EN) MULTI-CORE CLOCKING SYSTEM WITH INTERLOCKED 'ANTI-FREEZE' MECHANISM
(FR) SYSTÈME D'HORLOGE À NOYAUX MULTIPLES AVEC UN MÉCANISME 'ANTIGEL' VERROUILLÉ
Abstract: front page image
(EN)A clocking system (10), comprises a plurality of clocked data processing devices (12, 14) and a clock control circuit (18) controlling a generation of a plurality of clock signals and an application of the clock signals to the plurality of data processing devices (12, 14), allowing to clock at least one of the data processing devices while freezing all but the at least one of the data processing devices. A method (64) for clocking a plurality of clocked data processing devices (12, 14) comprises controlling a generation (66) of a plurality of clock signals and controlling an application (68) of the clock signals to the plurality of data processing devices (12, 14), allowing to clock at least one of the data processing devices while freezing all but the at least one of the data processing devices.
(FR)L'invention concerne un système d'horloge (10), comprenant une pluralité de dispositifs de traitement de données réglés au temps d'horloge (12, 14) et un circuit de commande d'horloge (18) commandant une génération d'une pluralité de signaux d'horloge et une application des signaux d'horloge à la pluralité de dispositifs de traitement de données (12, 14), permettant de régler au temps d'horloge au moins un des dispositifs de traitement de données tout en gelant tous les dispositifs sauf l'au moins un des dispositifs de traitement de données. Un procédé (64) pour régler au temps d'horloge une pluralité de dispositifs de traitement de données réglés au temps d'horloge (12, 14) comprend la commande d'une génération (66) d'une pluralité de signaux d'horloge et la commande d'une application (68) des signaux d'horloge à la pluralité de dispositifs de traitement de données (12, 14), permettant de régler au temps d'horloge au moins un des dispositifs de traitement de données tout en gelant tous les dispositifs sauf l'au moins un des dispositifs de traitement de données.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)