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1. (WO2009142645) SECURE RANDOM NUMBER GENERATOR
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2009/142645    International Application No.:    PCT/US2008/064679
Publication Date: 26.11.2009 International Filing Date: 23.05.2008
Chapter 2 Demand Filed:    10.07.2009    
IPC:
G06F 7/58 (2006.01), G11C 5/00 (2006.01)
Applicants: AGERE SYSTEMS INC. [US/US]; 1110 American Parkway NE Allentown, PA 18109 (US) (For All Designated States Except US).
HARRIS, Edward, B. [US/US]; (US) (For US Only).
HOGG, Richard [US/US]; (US) (For US Only).
KOHLER, Ross, A. [US/US]; (US) (For US Only).
MCPARTLAND, Richard, J. [US/US]; (US) (For US Only).
WERNER, Wayne, E. [US/US]; (US) (For US Only)
Inventors: HARRIS, Edward, B.; (US).
HOGG, Richard; (US).
KOHLER, Ross, A.; (US).
MCPARTLAND, Richard, J.; (US).
WERNER, Wayne, E.; (US)
Agent: ELLENBOGEN, Wayne, L.; Ryan, Mason & Lewis, LLP, 90 Forest Avenue, Locust Valley, NY 11560 (US)
Priority Data:
Title (EN) SECURE RANDOM NUMBER GENERATOR
(FR) GÉNÉRATEUR DE NOMBRE ALÉATOIRE SÉCURISÉ
Abstract: front page image
(EN)A random number generator circuit includes a first memory having multiple storage elements. Each of the storage elements has an initial state corresponding thereto when powered up by a voltage supply source applied to the first memory. The first memory is operative to generate a first signal including multiple bits indicative of the respective initial states of the storage elements. The random number generator circuit further includes an error correction circuit coupled to the first memory. The error correction circuit is operative to receive the first signal and to correct at least one bit in the first signal that is not repeatable upon successive applications of power to the first memory to thereby generate a second signal. The second signal is a random number that is repeatable upon successive applications of power to the first memory.
(FR)L'invention porte sur un circuit de générateur de nombre aléatoire qui comprend une première mémoire ayant de multiples éléments de stockage. Chacun des éléments de stockage a un état initial correspondant à celui-ci lorsqu'il est mis sous tension par une source d'alimentation de tension appliquée à la première mémoire. La première mémoire est fonctionnelle pour générer un premier signal comprenant de multiples bits indicatifs des états initiaux respectifs des éléments de stockage. Le circuit de générateur de nombre aléatoire comprend en outre un circuit de correction d'erreur couplé à la première mémoire. Le circuit de correction d'erreur est opérationnel pour recevoir le premier signal et pour corriger au moins un bit dans le premier signal qui est non répétable lors d'applications successives de puissance à la première mémoire pour ainsi générer un second signal. Le second signal est un nombre aléatoire qui est répétable lors d'applications successives de puissance à la première mémoire.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)