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1. (WO2009140306) SWITCHED-CAPACITOR DECIMATOR
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2009/140306    International Application No.:    PCT/US2009/043669
Publication Date: 19.11.2009 International Filing Date: 12.05.2009
IPC:
H03H 19/00 (2006.01)
Applicants: QUALCOMM INCORPORATED [US/US]; Attn: International IP Administration 5775 Morehouse Drive San Diego, CA 92121 (US) (For All Designated States Except US).
FAGG, Russell [US/US]; (US) (For US Only)
Inventors: FAGG, Russell; (US)
Agent: XU, Jiayu; Attn: International IP Administration 5775 Morehouse Drive San Diego, CA 92121 (US)
Priority Data:
12/120,207 13.05.2008 US
Title (EN) SWITCHED-CAPACITOR DECIMATOR
(FR) DÉCIMATEUR À CAPACITÉ COMMUTÉE
Abstract: front page image
(EN)A switched-capacitor decimator that can attenuate undesired signal components at odd harmonics of an output sample rate is described. In one design, the switched-capacitor decimator includes at least one sampling capacitor and multiple switches. For each sampling capacitor, the top plate is charged with a first input signal when the capacitor is selected for top charging, and the bottom plate is charged with a second input signal when the capacitor is selected for bottom charging. For each sampling capacitor, the top plate provides its stored charges to a first output signal and the bottom plate provides its stored charges to a second output signal when the capacitor is selected for reading. The switches couple the at least one sampling capacitor to the first and second input signals for charging and to the first and second output signals for reading.
(FR)L'invention porte sur un décimateur à capacité commutée qui peut atténuer des composants de signal non souhaités à des harmoniques impairs d'un niveau d'échantillonnage de sortie. Dans une mise en œuvre, le décimateur à capacité commutée comprend au moins un condensateur d'échantillonnage et de multiples commutateurs. Pour chaque condensateur d'échantillonnage, la plaque supérieure est chargée avec un premier signal d'entrée lorsque le condensateur est sélectionné pour un chargement par le haut, et la plaque inférieure est chargée avec un second signal d'entrée lorsque le condensateur est sélectionné pour un chargement par le bas. Pour chaque condensateur d'échantillonnage, la plaque supérieure fournit ses charges stockées à un premier signal de sortie et la plaque inférieure fournit ses charges stockées à un second signal de sortie lorsque le condensateur est sélectionné pour une lecture. Les commutateurs couplent l'au moins un condensateur d'échantillonnage aux premier et second signaux d'entrée pour un chargement et aux premier et second signaux de sortie pour une lecture.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)