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1. (WO2009140037) THERMAL MANAGEMENT OF GRAPHICS PROCESSING UNITS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2009/140037    International Application No.:    PCT/US2009/041446
Publication Date: 19.11.2009 International Filing Date: 22.04.2009
IPC:
G09G 5/18 (2006.01), G09G 5/36 (2006.01), G06F 1/08 (2006.01), G06F 1/32 (2006.01)
Applicants: APPLE INC. [US/US]; Attn: Patent Dept. 1 Infinite Loop, M/S 40-PAT Cupertino, CA 95014 (US) (For All Designated States Except US).
HENDRY, Ian [US/US]; (US) (For US Only).
SUMPTER, Anthony, Graham [US/US]; (US) (For US Only)
Inventors: HENDRY, Ian; (US).
SUMPTER, Anthony, Graham; (US)
Agent: HEMENWAY, S., Craig; Republic Plaza Building, Suite 4700 370 Seventeenth Street Denver, CO 80202 (US)
Priority Data:
61/053,519 15.05.2008 US
12/212,805 18.09.2008 US
Title (EN) THERMAL MANAGEMENT OF GRAPHICS PROCESSING UNITS
(FR) GESTION THERMIQUE D’UNITÉ DE TRAITEMENT GRAPHIQUE
Abstract: front page image
(EN)Some embodiments include a graphics processing with thermal management capabilities. The graphics processing unit may include a display controller, a microprocessing engine coupled to the display controller, and a clock circuit coupled to the display controller and the microprocessing engine. The clock circuit may further include a raw clock signal coupled to the display controller, a divider coupled to the raw clock signal, and a multiplexer coupled to the divider. The divider may generate a divided version of the raw clock signal, which may be coupled to the multiplexer along with the raw clock signal. The multiplexer may selectively provide the raw clock signal and/or the divided version of the clock signal to the microprocessing engine such that the microprocessing engine may receive a timing signal that is independent of operations of the graphics processing unit and result in fewer glitches.
(FR)Selon certains modes de réalisation, la présente invention concerne une unité traitement graphique avec des capacités de gestion thermique. L’unité de traitement graphique peut comporter un contrôleur d’affichage, un moteur d’unité centrale à microprocesseur couplé au contrôleur d’affichage, et un circuit d’horloge couplé au contrôleur d’affichage et au moteur d’unité centrale à microprocesseur. Le circuit d’horloge peut également comporter un signal d’horloge brut couplé au contrôleur d’affichage, un diviseur couplé au signal d’horloge brut, et un multiplexeur couplé au diviseur. Le diviseur peut générer une version divisée du signal d’horloge brut, qui peut être couplé au multiplexeur conjointement avec le signal d’horloge brut. Le multiplexeur peut fournir de manière sélective le signal d’horloge brut et/ou la version divisée du signal d’horloge au moteur d’unité centrale à microprocesseur de sorte que le moteur d’unité centrale à microprocesseur puisse recevoir un signal de synchronisation qui est indépendant des opérations de l’unité de traitement graphique et entraîne moins de rayures.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)