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1. (WO2008102284) INTEGRATED CIRCUIT AND ELECTRONIC DEVICE
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2008/102284    International Application No.:    PCT/IB2008/050521
Publication Date: 28.08.2008 International Filing Date: 13.02.2008
IPC:
G06F 13/42 (2006.01)
Applicants: NXP B.V. [NL/NL]; High Tech Campus 60, NL-5656 AG Eindhoven (NL) (For All Designated States Except US).
VITANESCU, Mihai [RO/CH]; (GB) (For US Only)
Inventors: VITANESCU, Mihai; (GB)
Agent: WHITE, Andrew, G.; c/o NXP Semiconductors, IP Department, Cross Oak Lane, Redhill Surrey RH1 5HA (GB)
Priority Data:
07102663.7 19.02.2007 EP
Title (EN) INTEGRATED CIRCUIT AND ELECTRONIC DEVICE
(FR) CIRCUIT INTÉGRÉ ET DISPOSITIF ÉLECTRONIQUE
Abstract: front page image
(EN)An IC (100) for communicating over a data communication bus (220) comprising a first pair of conductors including a data signal conductor (SDA) and a synchronization signal conductor (SCL), e.g. an I2C bus, is disclosed. The IC comprises a group of address pins (106a-c) for defining the bus address of the integrated circuit (100), each address pin being arranged to be coupled to a conductor from a group of conductors comprising the first pair of conductors and a second pair of conductors including a conductor for carrying a fixed high potential (Vdd) and a conductor for carrying an fixed low potential (GND). The IC (100) further comprises first and second further pins (102, 104) for being coupled to the data signal conductor (SDA) and the synchronization signal conductor (SCL) respectively and a bus address decoder(110) comprising, for each address pin, first means (118) for distinguishing between the first pair of conductors and the second pair of conductors and second means (112, 116) for distinguishing between the conductors belonging to the same pair of conductors. The IC (100) of the present invention provides an area-efficient implementation of an address decoder (110) capable of decoding addresses in an enhanced addressing scheme. In addition, an electronic device (200 comprising a data communication bus (220) and an IC (100) coupled to the data communication bus (220) is disclosed.
(FR)La présente invention concerne un IC (100) permettant de communiquer sur un bus de communication de données (220) comprenant une première paire de conducteurs comprenant un conducteur de signal de données (SDA) et un conducteur de signal de synchronisation (SCL), par exemple un bus I2C. L'IC comprend un groupe de broches d'adressage (106a-c) permettant de définir l'adresse du bus du circuit intégré (100), chaque broche d'adressage étant conçue pour être couplée à un conducteur d'un groupe de conducteurs comprenant la première paire de conducteurs et une seconde paire de conducteurs comprenant un conducteur permettant de transporter un potentiel élevé fixe (Vdd) et un conducteur permettant de transporter un potentiel bas fixe (GND). L'IC (100) comprend en outre des première et seconde broches supplémentaires (102, 104) respectivement destinées à être couplées au conducteur de signal de données (SDA) et au conducteur de signal de synchronisation (SCL), ainsi qu'un décodeur d'adresse de bus (110) comprenant, pour chaque broche d'adressage, des premiers moyens (118) adaptés pour distinguer la première paire de conducteurs de la seconde paire de conducteurs et des seconds moyens (112, 116) adaptés pour distinguer les conducteurs appartenant à la même paire de conducteurs. L'IC (100) de la présente invention permet une mise en œuvre peu encombrante d'un décodeur d'adresses (110) capable de décoder des adresses selon un schéma d'adressage amélioré. La présente invention concerne en outre un dispositif électronique (200) comprenant un bus de communication de données (220) et un IC (100) couplé au bus de communication de données (220).
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)