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1. WO2007146544 - PROCESSOR CORE STACK EXTENSION

Publication Number WO/2007/146544
Publication Date 21.12.2007
International Application No. PCT/US2007/069191
International Filing Date 17.05.2007
IPC
G06F 9/50 2006.01
GPHYSICS
06COMPUTING; CALCULATING OR COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
46Multiprogramming arrangements
50Allocation of resources, e.g. of the central processing unit
CPC
G06F 12/0875
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
12Accessing, addressing or allocating within memory systems or architectures
02Addressing or allocation; Relocation
08in hierarchically structured memory systems, e.g. virtual memory systems
0802Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
0875with dedicated cache, e.g. instruction or stack
G06F 9/485
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
46Multiprogramming arrangements
48Program initiating; Program switching, e.g. by interrupt
4806Task transfer initiation or dispatching
4843by program, e.g. task dispatcher, supervisor, operating system
485Task life-cycle, e.g. stopping, restarting, resuming execution
Applicants
  • QUALCOMM Incorporated [US]/[US] (AllExceptUS)
  • JIAO, Guofang [CN]/[US] (UsOnly)
  • YU, Chun [CN]/[US] (UsOnly)
  • DU, Yun [CN]/[US] (UsOnly)
Inventors
  • JIAO, Guofang
  • YU, Chun
  • DU, Yun
Agents
  • OGROD, Gregory, D.
Priority Data
11/448,27206.06.2006US
Publication Language English (EN)
Filing Language English (EN)
Designated States
Title
(EN) PROCESSOR CORE STACK EXTENSION
(FR) Extension de pile de cœur de processeur
Abstract
(EN)
In general, the disclosure is directed to techniques for controlling stack overflow. The techniques described herein utilize a portion of a common cache or memory located outside of the processor core as a stack extension. A processor core monitors a stack within the processor core and transfers the content of the stack to the stack extension outside of the processor core when the processor core stack exceeds a maximum number of entries. When the processor core determines the stack within the processor core falls below a minimum number of entries the processor core transfers at least a portion of the content maintained in the stack extension into the stack within the processor core. The techniques prevent malfunction and crash of threads executing within the processor core by utilizing stack extensions outside of the processor core.
(FR)
L'invention concerne en général des techniques pour réguler le débordement de pile. Les techniques décrites dans la présente invention utilisent une partie d'une antémémoire ou d'une mémoire commune située en dehors du cœur de processeur comme une extension de pile. Un cœur de processeur surveille une pile à l'intérieur du cœur de processeur et transfère le contenu de la pile à l'extension de pile à l'extérieur du cœur de processeur lorsque la pile de cœur de processeur dépasse un nombre maximal d'entrées. Lorsque le cœur de processeur détermine que la pile à l'intérieur du cœur de processeur se trouve en dessous d'un nombre minimal d'entrées, le cœur de processeur transfère au moins une partie du contenu maintenu dans l'extension de pile dans la pile à l'intérieur du cœur de processeur. Les techniques empêchent le dysfonctionnement et le plantage des fils s'exécutant à l'intérieur du cœur de processeur en utilisant des extensions de pile à l'extérieur du cœur de processeur.
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