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1. (WO2007098445) INTERNALLY DERIVED ADDRESS GENERATION SYSTEM AND METHOD FOR BURST LOADING OF A SYNCHRONOUS MEMORY
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2007/098445    International Application No.:    PCT/US2007/062433
Publication Date: 30.08.2007 International Filing Date: 20.02.2007
IPC:
G11C 8/04 (2006.01), G11C 7/10 (2006.01)
Applicants: CYPRESS SEMICONDUCTOR CORP. [US/US]; 198 Champion Court, San Jose, CA 95134 (US) (For All Designated States Except US).
REZEANU, Stefan-Cristian [US/US]; (US) (For US Only)
Inventors: REZEANU, Stefan-Cristian; (US)
Agent: DAFFER, Kevin, L.; Daffer McDaniel, LLP, P.O. Box 684908, Austin, TX 78768-4908 (US)
Priority Data:
11/359,205 21.02.2006 US
Title (EN) INTERNALLY DERIVED ADDRESS GENERATION SYSTEM AND METHOD FOR BURST LOADING OF A SYNCHRONOUS MEMORY
(FR) SYSTÈME ET PROCÉDÉ DE GÉNÉRATION D'ADRESSES DÉRIVÉES DE MANIÈRE INTERNE POUR LE CHARGEMENT EN RAFALE D'UNE MÉMOIRE SYNCHRONE
Abstract: front page image
(EN)An address generation system and method is provided for internally storing and thereafter producing an address to be sent to a memory device. The address that is stored need not be sent from an external address bus at each clock cycle, but the processing can remain internal to the memory device. The burst-block starting address can be stored in the mirror register (52) and output from a selector circuit, such as a multiplexer (54) when that address is chosen. Otherwise, the multiplexer can simply perform its normal operation of selecting between an address pointed to by a counter (60), the external address (ADDR, IN), or the incremented counter output, based on the state of the external counter control signals. The system includes a mirror register, a counter, and a multiplexer that selects either the mirror register stored address or the internally processed address.
(FR)L'invention concerne un système et un procédé de génération d'adresses permettant de stocker de manière interne et de produire ensuite une adresse à envoyer à un dispositif à mémoire. L'adresse qui est stockée ne doit pas être envoyée à partir d'un bus d'adresses externe à chaque cycle d'horloge, mais le traitement peut demeurer interne au dispositif à mémoire. L'adresse de début de bloc-rafale peut être stockée dans le registre miroir (52) et sortie à partir d'un circuit sélecteur, tel qu'un multiplexeur (54) lorsque ladite adresse est choisie. Sinon, le multiplexeur peut simplement exécuter son opération normale de sélection entre une adresse désignée par un compteur (60), l'adresse externe (ADDR, IN) ou la sortie de compteur incrémentée, en fonction de l'état des signaux de commande du compteur externe. Le système comprend un registre miroir, un compteur et un multiplexeur qui sélectionne l'adresse stockée du registre miroir ou l'adresse traitée de manière interne.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)