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1. (WO2007097007) MEMORY CONTROL APPARATUS AND MEMORY CONTROL METHOD
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2007/097007    International Application No.:    PCT/JP2006/303497
Publication Date: 30.08.2007 International Filing Date: 24.02.2006
IPC:
G06F 12/00 (2006.01)
Applicants: FUJITSU LIMITED [JP/JP]; 1-1, Kamikodanaka 4-chome Nakahara-ku, Kawasaki-shi Kanagawa 2118588 (JP) (For All Designated States Except US).
IWASAKI, Shinichi [JP/JP]; (JP) (For US Only)
Inventors: IWASAKI, Shinichi; (JP)
Agent: OSUGA, Yoshiyuki; 3rd Fl., Nibancho Bldg. 8-20, Nibancho, Chiyoda-ku Tokyo 1020084 (JP)
Priority Data:
Title (EN) MEMORY CONTROL APPARATUS AND MEMORY CONTROL METHOD
(FR) APPAREIL ET PROCEDE DE COMMANDE DE MEMOIRE
(JA) メモリ制御装置およびメモリ制御方法
Abstract: front page image
(EN)A memory control apparatus and a memory control method, in which a buffer memory can be effectively used in a large-scale system LSI by providing the buffer memory for temporarily storing data to be stored in a memory, receiving an instruction to the memory, transmitting, according to the received instruction, a buffer memory securing exclusive packet to secure the necessary capacity of the buffer memory in the buffer memory by the instruction, receiving a buffer memory confirmation signal corresponding to the transmitted buffer memory securing exclusive packet and executing the received instruction according to the received buffer memory confirmation signal.
(FR)La présente invention concerne un appareil et un procédé de commande de mémoire, dans lesquels une mémoire tampon peut être efficacement utilisée dans un LSI de système à grande échelle en fournissant la mémoire tampon pour stocker temporairement des données à stocker dans une mémoire, recevoir une instruction vers la mémoire, transmettre, en fonction des instructions reçues, une mémoire tampon sécurisant un paquet exclusif afin de sécuriser la capacité nécessaire de la mémoire tampon dans la mémoire tampon par l'instruction, recevoir un signal de confirmation de mémoire tampon correspondant à la mémoire tampon transmise sécurisant un paquet exclusif et exécuter l'instruction reçue en fonction du signal de confirmation de mémoire tampon reçu.
(JA) メモリに格納されるデータを一時的に格納するバッファメモリを備え、メモリに対する命令を受信し、受信した命令に基づいて、命令によって必要なバッファメモリの容量をバッファメモリに確保するためのバッファメモリ確保専用パケットを送信し、送信されたバッファメモリ確保専用パケットに対応するバッファメモリ確認信号を受信し、受信したバッファメモリ確認信号に基づいて、受信した命令を実行することにより、大規模システムLSIにおいてバッファメモリを効率的に利用することが可能なメモリ制御装置およびメモリ制御方法を提供する。
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)