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Pub. No.:    WO/2007/088710    International Application No.:    PCT/JP2007/000046
Publication Date: 09.08.2007 International Filing Date: 31.01.2007
G01J 1/44 (2006.01), H01L 27/146 (2006.01), H01L 31/10 (2006.01), H04N 5/353 (2011.01), H04N 5/355 (2011.01), H04N 5/3745 (2011.01), H04N 5/374 (2011.01)
Applicants: NATIONAL UNIVERSITY CORPORATION NARA INSTITUTE OF SCIENCE AND TECHNOLOGY [JP/JP]; 8916-5 Takayama-cho, Ikoma-shi, Nara 6300192 (JP) (For All Designated States Except US).
SANYO ELECTRIC CO., LTD. [JP/JP]; 5-5, Keihan-Hondori 2-chome, Moriguchi-shi, Osaka 5708677 (JP) (For All Designated States Except US).
KAGAWA, Keiichiro [JP/JP]; (JP) (For US Only).
OHTA, Jun [JP/JP]; (JP) (For US Only).
NOSE, Yugo [JP/JP]; (JP) (For US Only).
WADA, Atsushi [JP/JP]; (JP) (For US Only).
TAKASHIMA, Hajime [JP/JP]; (JP) (For US Only)
Inventors: KAGAWA, Keiichiro; (JP).
OHTA, Jun; (JP).
NOSE, Yugo; (JP).
WADA, Atsushi; (JP).
Agent: MORISHITA, Sakaki; 2-11-12 Ebisu-Nishi Shibuya-ku, Tokyo 1500021 (JP)
Priority Data:
2006-026391 02.02.2006 JP
2006-026392 02.02.2006 JP
(JA) 光検出装置
Abstract: front page image
(EN)A pixel circuit includes a photo diode, an overflow circuit, a first detection circuit, and a second detection circuit. The first detection circuit charges and discharges a cathode capacitance by photo current Iph flowing in the photo diode (PD) and amplifies the obtained voltage by a source follower amplifier to be outputted to a data line. The second detection circuit charges and discharges a cathode capacitance by the photo current Iph flowing in the photo diode (PD) and outputs the electric charge accumulated in the cathode capacitance via the data line. The pixel circuit is configured so as to switch between a first mode when the first detection circuit is active and a second mode when the second detection circuit is active. According to the light reception quantity of the photo diode contained in the pixel circuit, switching is performed between the first and the second mode. In the first mode, the amplification ratio is controlled according to the light reception quantity. In the second mode, the accumulation time is controlled.
(FR)La présente invention concerne un circuit de pixels qui inclut une photodiode, un circuit de débordement, un premier circuit de détection et un second circuit de détection. Le premier circuit de détection charge et décharge une capacitance de cathode par photocourant Iph s'écoulant dans la photodiode (PD) et amplifie la tension obtenue par un amplificateur suiveur de source à transmettre à une ligne de données. Le second circuit de détection charge et décharge une capacitance de cathode par le photocourant Iph s'écoulant dans la photodiode (PD) et transmet la charge électrique accumulée dans la capacitance de cathode par le biais de la ligne de données. Le circuit de pixels est configuré de manière à commuter entre un premier mode lorsque le premier circuit de détection est actif et un second mode lorsque le second circuit de détection est actif. En fonction de la quantité de réception de lumière de la photodiode contenue dans le circuit de pixels, la commutation est effectuée entre le premier et le second mode. Dans le premier mode, le rapport d'amplification est commandé en fonction de la quantité de réception de lumière. Dans le second mode, le temps d'accumulation est commandé.
(JA) 画素回路は、フォトダイオード、オーバーフロー回路、第1検出回路、第2検出回路を含む。第1検出回路は、フォトダイオードPDに流れる光電流Iphによってカソード容量を充放電し、得られた電圧をソースフォロアアンプによって増幅してデータ線に出力する。第2検出回路は、フォトダイオードPDに流れる光電流Iphによってカソード容量を充放電し、カソード容量に蓄えられた電荷をデータ線を介して出力する。画素回路は、第1検出回路がアクティブとなる第1モードと、第2検出回路がアクティブとなる第2モードと、が切り替え可能に構成される。各画素回路に含まれるフォトダイオードの受光量に応じて、第1、第2モードを切り替え、第1モードにおいて、受光量に応じて増幅率を制御し、第2モードにおいて、蓄積時間を制御する。
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)