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1. (WO2007017445) MICROPROCESSOR SYSTEM FOR CONTROLLING AND/OR REGULATING AT LEAST PARTLY SECURITY-CRITICAL PROCESSES
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2007/017445    International Application No.:    PCT/EP2006/064977
Publication Date: 15.02.2007 International Filing Date: 02.08.2006
IPC:
G06F 11/10 (2006.01), G06F 11/16 (2006.01)
Applicants: CONTINENTAL TEVES AG & CO. OHG [DE/DE]; Guerickestrasse 7, 60488 Frankfurt (DE) (AE, AG, AL, AM, AT, AU, AZ, BA, BB, BE, BF, BG, BJ, BR, BW, BY, BZ, CA, CF, CG, CH, CI, CM, CN, CO, CR, CU, CY, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, FR, GA, GB, GD, GE, GH, GM, GN, GQ, GR, GW, HN, HR, HU, ID, IE, IL, IN, IS, IT, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MC, MD, MG, MK, ML, MN, MR, MW, MX, MZ, NA, NE, NG, NI, NL, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SI, SK, SL, SM, SN, SY, SZ, TD, TG, TJ, TM, TN, TR, TT, TZ, UA, UG, UZ, VC, VN, ZA, ZM, ZW only).
FEY, Wolfgang [DE/DE]; (DE) (For US Only).
KIRSCHBAUM, Andreas [DE/DE]; (DE) (For US Only).
TRASKOV, Adrian [DE/DE]; (DE) (For US Only)
Inventors: FEY, Wolfgang; (DE).
KIRSCHBAUM, Andreas; (DE).
TRASKOV, Adrian; (DE)
Common
Representative:
CONTINENTAL TEVES AG & CO. OHG; Guerickestrasse 7, 60488 Frankfurt (DE)
Priority Data:
10 2005 038 306.8 11.08.2005 DE
10 2006 036 386.8 02.08.2006 DE
Title (DE) MIKROPROZESSORSYSTEM ZUR STEUERUNG BZW. REGELUNG VON ZUMINDEST ZUM TEIL SICHERHEITSKRITISCHEN PROZESSEN
(EN) MICROPROCESSOR SYSTEM FOR CONTROLLING AND/OR REGULATING AT LEAST PARTLY SECURITY-CRITICAL PROCESSES
(FR) SYSTEME DE MICROPROCESSEUR POUR COMMANDER OU REGLER DES PROCESSUS RELEVANT AU MOINS EN PARTIE DE LA SECURITE
Abstract: front page image
(DE)Mikroprozessorsystem (60) zur Steuerung bzw. Regelung von zumindest zum Teil sicherheitskritischen Prozessen umfassend zwei in einem Chipgehäuse integrierte Zentralrecheneinheiten (1,2), ein erstes und ein zweites Bussystem, zumindest einen vollständiger Speicher (7) am ersten Bussystem, Prüfdaten in einem oder mehreren Prüfdatenspeichern, die mit Daten des Speichers am ersten Bussystem zusammenhängen, wobei der Prüfdatenspeicher kleiner als der vollständige Speicher ist, und dass die Bussysteme Vergleichs- und/oder Treiberkomponenten umfassen, welche den Datenaustausch und/oder Vergleich von Daten zwischen den beiden Bussystemen ermöglichen, bei dem der oder die Prüfdatenspeicher am ersten Bussystem angeordnet ist/sind, und am zweiten Bussystem weder ein Prüfdatenspeicher, noch ein Speicher angeordnet ist, welcher zur Absicherung von Daten des Speichers am ersten Buseingesetzt wird. Die Erfindung betrifft weiterhin die Verwendung des obigen Mikroprozessorssystems in Kraftfahrzeugsteuergeräten.
(EN)The invention relates to a microprocessor system (60) for controlling and/or regulating at least partly security-critical processes, which system comprises two central processing units (1, 2) integrated into a chip housing, a first and a second bus system, at least one complete memory (7) on the first bus system, and check data in one or more check data memories, said data being related to data of the memory in the first bus system. The check data memory is smaller than the complete memory. The bus systems comprise comparative and/or driver components which facilitate data exchange and/or comparison of data between the two bus systems. The one or more check data memories are arranged on the first bus system. On the second bus system, neither a check data memory nor a memory safeguarding data of the memory on the first bus is used. The invention also relates to the use of the inventive microprocessor system in automotive control devices.
(FR)La présente invention concerne un système de microprocesseur (60) pour commander ou régler des processus relevant au moins en partie de la sécurité, comprenant: deux unités centrales de calcul (1,2) intégrées à un boîtier de puce; un premier et un second système de bus; au moins une mémoire intégrale (7) au niveau du premier système de bus; des données de vérification enregistrées dans une ou plusieurs mémoires de données de vérification, qui sont en relation avec des données de la mémoire au niveau du premier système de bus, la mémoire de données de vérification ayant des dimensions réduites par rapport à celles de la mémoire intégrale. Selon l'invention, les systèmes de bus comprennent des composantes de comparaison et/ou de transfert qui permettent l'échange et/ou la comparaison de données entre les deux systèmes de bus, et la/les mémoires de données de vérification se trouve(nt) au niveau du premier système de bus, et le second système de bus ne comporte ni mémoire de données de vérification, ni mémoire utilisée pour sécuriser les données de la mémoire au niveau du premier système de bus. L'invention a également pour objet l'utilisation du système de microprocesseur décrit ci-dessus, dans des dispositifs de commande de véhicules automobiles.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: German (DE)
Filing Language: German (DE)